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申请/专利权人：台湾积体电路制造股份有限公司

摘要：集成电路。一种静态随机存取记忆体单元包含第一至第五介电鳍片，其沿第一方向依序设置并以第二方向为长度方向，第一及第五介电鳍片定义静态随机存取记忆体单元的两边缘；第一N型半导体鳍片，设置于第一及第二介电鳍片之间；第二N型半导体鳍片，设置于第四及第五介电鳍片之间；第一P型半导体鳍片，设置于第二及第三介电鳍片之间；第二P型半导体鳍片，设置于第三及第四介电鳍片之间，每个第一及第二N型半导体鳍片以及每个第一及第二P型半导体鳍片以第二方向为长度方向；以及栅极结构，以第一方向为长度方向设置，栅极结构接合一或多个介电鳍片。

主权项：1.一种集成电路，其特征在于，包含：一第一SRAM单元，以一第一方向为该第一SRAM单元的长度方向且以一第二方向为该第一SRAM单元的宽度方向，其中该第二方向大致垂直于该第一方向，其中该第一SRAM单元设置于一基板上，其中该第一SRAM单元包含：一第一介电鳍片、一第二介电鳍片、一第三介电鳍片以及一第四介电鳍片，沿该第一方向依序设置并以该第二方向为该第一介电鳍片至该第四介电鳍片的长度方向设置，其中该第一介电鳍片与该第四介电鳍片定义该第一SRAM单元的二个侧边，其中该第一介电鳍片、该第二介电鳍片、该第三介电鳍片以及该第四介电鳍片的底部设置于该基板上的多个隔离结构中；一第一P型半导体鳍片，设置于该第一介电鳍片及该第二介电鳍片之间；一第二P型半导体鳍片，设置于该第三介电鳍片及该第四介电鳍片之间；一第一N型半导体鳍片以及一第二N型半导体鳍片，设置于该第二介电鳍片及该第三介电鳍片之间，其中该第一P型半导体鳍片及该第二P型半导体鳍片以及该第一N型半导体鳍片及该第二N型半导体鳍片以该第二方向为长度方向设置，且其中所述多个隔离结构将每一该第一P型半导体鳍片及该第二P型半导体鳍片以及该第一N型半导体鳍片及该第二N型半导体鳍片分隔于每一该第一介电鳍片、该第二介电鳍片、该第三介电鳍片以及该第四介电鳍片；以及多个栅极结构，以该第一方向为所述多个栅极结构的长度方向设置，其中所述多个栅极结构沿该第二方向分隔开来，其中所述多个栅极结构接合该第一介电鳍片至该第四介电鳍片、该第一N型半导体鳍片及该第二N型半导体鳍片以及该第一P型半导体鳍片及该第二P型半导体鳍片的一或多个。

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