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申请/专利权人:深圳忆联信息系统有限公司
摘要:本发明涉及一种时钟电路结构,包括一个或一个以上的输入单元,输出选择器,及输出反相器;所述输入单元包括输入选择器,及输入反相器;所述输入选择器的输入端用于接收原时钟脉冲信号,输出端与所述输入反相器的输入端连接,输入反相器的输出端与所述输出选择器的输入端连接,输出选择器的输出端与输出反相器的输入端连接,输出反相器的输出端用于输出偏移后的时钟脉冲信号。本发明解决了时钟电路中多路选择时,时钟向一个方向偏移的问题,保证时钟占空比为50%。
主权项:1.一种时钟电路结构,其特征在于,包括一个或一个以上的输入单元,输出选择器,及输出反相器;所述输入单元包括输入选择器,及输入反相器;所述输入选择器的输入端用于接收原时钟脉冲信号,输出端与所述输入反相器的输入端连接,输入反相器的输出端与所述输出选择器的输入端连接,输出选择器的输出端与输出反相器的输入端连接,输出反相器的输出端用于输出偏移后的时钟脉冲信号。
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百度查询: 深圳忆联信息系统有限公司 一种时钟电路结构
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