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申请/专利权人：山东产研鲲云人工智能研究院有限公司
摘要：本发明公开一种时钟分频电路及电子设备，时钟分频电路包括：控制电路接收第一外部设备输出的时钟信号和时钟分频系数，输出对应的奇偶数触发信号，还对接收到的时钟信号进行计数得到计数值，并根据所述计数值与所述时钟分频系数的对应关系，通过所述输出端输出翻转触发信号；第一触发器接收到翻转触发信号时采集时钟信号上升沿输出第一时钟采集信号；第二触发器接收到奇数触发信号及第一时钟采集信号时采集时钟信号下降沿输出第二时钟采集信号；输出逻辑门电路在第一时钟采集信号和第二时钟采集信号满足预设触发条件时输出时钟输出信号至外部设备。本发明解决了支持奇数和偶数50％占空比的时钟分频器结构复杂、生产成本高及重用性低的问题。
主权项：1.一种时钟分频电路，其特征在于，所述时钟分频电路包括：控制电路，所述控制电路用于接收第一外部设备输出的时钟信号和时钟分频系数，并根据所述时钟分频系数通过输出端输出对应的奇偶数触发信号，所述控制电路还用于对接收到的所述时钟信号进行计数得到计数值，并根据所述计数值与所述时钟分频系数的对应关系，通过所述输出端输出翻转触发信号；第一触发器，所述第一触发器的输入端与所述控制电路的输出端连接；所述第一触发器用于接收所述第一外部设备输出的时钟信号，并在接收到所述翻转触发信号时，采集所述时钟信号的上升沿，以输出与所述时钟信号的上升沿对应的第一时钟采集信号；第二触发器，所述第二触发器的输入端分别与所述第一触发器的输出端、所述控制电路的输出端连接；所述第二触发器用于在接收到奇数触发信号及所述第一时钟采集信号时，采集所述时钟信号的下降沿，以输出与所述时钟信号的下降沿对应的第二时钟采集信号；输出逻辑门电路，所述输出逻辑门电路的输入端分别与所述第一触发器、所述第二触发器的输出端连接，所述输出逻辑门电路的输出端用于连接第二外部设备，所述输出逻辑门电路还用于在所述第一时钟采集信号和所述第二时钟采集信号满足第二预设触发条件时输出对应占空比的时钟输出信号至所述第二外部设备。
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权利要求：
百度查询： 山东产研鲲云人工智能研究院有限公司 时钟分频电路及电子设备
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