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申请/专利权人：中国人民解放军国防科技大学

摘要：本发明公开了一种高速低功耗主从D触发器，主从D触发器包括数据输入电路、主触发电路、从触发电路以及数据输出电路；数据输入电路、主触发电路、从触发电路和数据输出电路依次相连；数据输入电路，用于接收数据输入信号；数据输出电路，用于将从触发电路的输出信号进行输出；主触发电路和从触发电路均由时钟信号CK控制；当时钟信号CK为低电平时，主触发电路接收数据输入信号，从触发电路处于维持状态；当时钟信号CK为高电平时，主触发电路处于维持状态，从触发电路接收主触发电路的存储状态。本发明具有速度快而功耗低等优点。

主权项：1.一种高速低功耗主从D触发器，其特征在于，包括数据输入电路、主触发电路、从触发电路以及数据输出电路；数据输入电路、主触发电路、从触发电路和数据输出电路依次相连；数据输入电路，用于接收数据输入信号；数据输出电路，用于将从触发电路的输出信号进行输出；主触发电路和从触发电路均由时钟信号CK控制；当时钟信号CK为低电平时，主触发电路接收数据输入信号，从触发电路处于维持状态；当时钟信号CK为高电平时，主触发电路处于维持状态，从触发电路接收主触发电路的存储状态；所述主触发电路包括PMOS管MP2-MP6，以及NMOS管MN2-MN6；PMOS管MP2衬底和源极接电源VDD，栅极由信号ml_b驱动，漏极驱动信号v1；PMOS管MP3衬底和源极接电源VDD，栅极由信号ml_ax驱动，漏极驱动信号v2；PMOS管MP6衬底接电源VDD，栅极受时钟信号CK控制，源极接信号v1，漏极接信号v2；PMOS管MP4衬底和源极接电源VDD，栅极由信号dn驱动，漏极驱动信号ml_b；PMOS管MP5衬底和源极接电源VDD，栅极由信号ml_b驱动，漏极驱动信号ml_ax；NMOS管MN6衬底和源极接地VSS，栅极受时钟信号CK控制；NMOS管MN2衬底接地VSS，栅极由信号ml_b驱动，漏极驱动信号dn，源极与NMOS管MN6的漏极相连；NMOS管MN3衬底接地VSS，栅极由信号ml_ax驱动，漏极驱动信号ml_b，源极与NMOS管MN6的漏极相连；NMOS管MN4衬底和源极接地VSS，栅极由信号dn驱动，漏极驱动信号ml_b；NMOS管MN5衬底和源极接地VSS，栅极由信号ml_b驱动，漏极驱动信号ml_ax；其中信号ml_ax和信号ml_b为主触发电路中的互补信号对；所述从触发电路包括PMOS管MP7-MP8，以及NMOS管MN7-MN12；NMOS管MN12衬底和源极接地VSS，栅极接时钟信号CK；NMOS管MN7衬底和源极接地VSS，栅极由信号sl_a驱动，漏极驱动信号sl_bx；NMOS管MN8衬底和源极接地VSS，栅极由信号sl_bx驱动，漏极驱动信号sl_a;NMOS管MN9衬底接地VSS，栅极接信号ml_b，而源极与NMOS管MN12的漏极相连，漏极驱动信号sl_bx；NMOS管MN10衬底接地VSS，栅极接信号ml_ax，源极与NMOS管MN12的漏极相连，漏极驱动信号sl_a；NMOS管MN11衬底接地VSS，栅极由时钟信号CK控制，源极接信号v1，漏极驱动信号sl_bx；PMOS管MP7衬底接电源VDD，源极由信号v1驱动，栅极由信号sl_a驱动，漏极驱动信号sl_bx;PMOS管MP8衬底接电源VDD，源极由信号v2驱动，栅极由信号sl_bx驱动，漏极驱动信号sl_a；信号sl_bx和信号sl_a为从触发电路中的互补信号对。

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百度查询： 中国人民解放军国防科技大学 一种高速低功耗主从D触发器