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摘要：本公开涉及算术逻辑单元、处理器、计算芯片和计算设备。公开了一种算术逻辑单元，用于接收两个二进制整数，能够实现针对其中至少一者的两种或更多种运算，算术逻辑单元包括：加法器，用于接收第一输入、第二输入和进位输入，并且输出第一输入、第二输入和进位输入的和，进位输入为1或0；第一输入选择模块，包括至少一个输入端，和耦合到加法器的第一输入的输出端；第二输入选择模块，包括至少两个输入端，和耦合到加法器的第二输入的输出端；进位输入选择模块，包括至少一个输入端，和耦合到加法器的进位输入的输出端；输出选择模块，包括至少三个输入端，和耦合到算术逻辑单元的输出端的输出端，至少一个输入端耦合到加法器输出的和。
主权项：1.一种算术逻辑单元，用于接收两个二进制整数a和b，能够实现针对a和b中至少一者的两种或更多种运算，所述算术逻辑单元包括：加法器，用于接收第一输入A、第二输入B以及进位输入Ci，并且输出第一输入A、第二输入B以及进位输入Ci的和S，其中进位输入Ci为1或0；第一输入选择模块，包括至少一个输入端，以及耦合到加法器的第一输入A的输出端，所述第一输入选择模块被配置为接收表示所述算术逻辑单元要实现的运算的标志，并且根据所述算术逻辑单元要实现的运算而选择性地输出一个值作为所述加法器的第一输入A；第二输入选择模块，包括至少两个输入端，以及耦合到加法器的第二输入B的输出端，所述第二输入选择模块被配置为接收表示所述算术逻辑单元要实现的运算的标志，并且根据所述算术逻辑单元要实现的运算而选择性地输出一个值作为所述加法器的第二输入B；进位输入选择模块，包括至少一个输入端，以及耦合到加法器的进位输入Ci的输出端，所述进位输入选择模块被配置为接收表示所述算术逻辑单元要实现的运算的标志，并且根据所述算术逻辑单元要实现的运算而选择性地输出0或1作为所述加法器的进位输入Ci；输出选择模块，包括至少三个输入端，以及耦合到算术逻辑单元的输出端的输出端，其中至少一个输入端耦合到加法器输出的和S，所述输出选择模块被配置为接收表示所述算术逻辑单元要实现的运算的标志，并且根据所述算术逻辑单元要实现的运算而选择性地输出一个值作为所述算术逻辑单元的输出。
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百度查询： 深圳比特微电子科技有限公司 算术逻辑单元、处理器、计算芯片和计算设备
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