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摘要：本发明公开了一种处理器、处理方法及相关设备，其中，包括数据选择单元、与数据选择单元连接的指令译码单元和M行*N列通用寄存器组；指令译码单元，用于对输入的X条指令进行译码，获取X条指令各自的至少一个源操作数地址，共计Y个源操作数地址；并将Y个源操作数地址发送至数据选择单元；Y个源操作数地址中的每一个源操作数地址中包括至少一个列地址位、至少一个行地址位和至少一个目标地址位；数据选择单元，用于根据第i个源操作数地址中包括的至少一个列地址位、至少一个行地址位和至少一个目标地址位在M行*N列通用寄存器组中访问第i个源操作数地址对应的通用寄存器，获取对应的源操作数。采用本发明，可以减少操作数的选数代价。
主权项：1.一种处理器，其特征在于，包括数据选择单元、与所述数据选择单元连接的指令译码单元和M行*N列通用寄存器组，所述M行*N列通用寄存器组中的每一个通用寄存器组包括K个通用寄存器；M、N和K为大于或者等于1的整数；其中，所述指令译码单元，用于对输入的X条指令进行译码，获取所述X条指令各自的至少一个源操作数地址，共计Y个源操作数地址；并将所述Y个源操作数地址发送至所述数据选择单元；所述Y个源操作数地址中的每一个源操作数地址中包括至少一个列地址位、至少一个行地址位和至少一个目标地址位；所述至少一个列地址位用于指示所述每一个源操作数地址所属的通用寄存器列，所述至少一个行地址位用于指示所述每一个源操作数地址所属的通用寄存器行；所述至少一个目标地址位用于指示所述每一个源操作数地址与所述K个通用寄存器中的第t个通用寄存器的对应关系；X、Y和t为大于或者等于1的整数；所述数据选择单元，用于根据第i个源操作数地址中包括的所述至少一个列地址位、所述至少一个行地址位和所述至少一个目标地址位在所述M行*N列通用寄存器组中访问所述第i个源操作数地址对应的通用寄存器，获取对应的源操作数；所述第i个源操作数地址为所述Y个源操作数地址中的一个；i为大于或者等于1，且小于或者等于Y的整数。
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百度查询： 华为技术有限公司 一种处理器、处理方法及相关设备
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