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摘要：本发明涉及一种快闪存储器控制器及快闪存储器控制器的方法。该方法包括：使用处理器通过总线发出并产生命令信号至控制逻辑电路；将命令信号缓存在输入输出电路的特定通道控制器的特定伫列中；以及使用仲裁器来控制特定缓冲器储存该特定通信接口的第一传输历史信息。
主权项：1.一种快闪存储器控制器，用于一储存装置中并通过一特定通信接口来耦接到该储存装置的一快闪存储器装置，该快闪存储器控制器包括有：一总线；一特定缓冲器，耦接到该总线；一处理器，耦接于该总线及该特定缓冲器；以及一控制逻辑电路，耦接至该总线、该特定缓冲器、该处理器以及通过该特定通信接口耦接至该快闪存储器装置，该控制逻辑电路包括：一比较电路；以及一输入输出电路，该输入输出电路具有多个通道控制器并分别对应于该快闪存储器装置的多个不同通道，一通道控制器包括一仲裁器及多个伫列，该多个伫列对应于一通道的多个不同芯片；其中该处理器通过该总线发出并产生一命令信号至该控制逻辑电路，该命令信号被缓存在该输入输出电路的一特定通道控制器的一特定伫列中；该仲裁器用以控制该特定缓冲器储存该特定通信接口的一第一传输历史信息；以及，该特定通信接口的该第一传输历史信息包含以下的其中至少一个：当该命令信号被该仲裁器所选择以输出该命令信号至该快闪存储器装置时的该命令信号的命令信息的一数据内容与一数据类型、当该命令信号被该仲裁器所选择以输出该命令信号至该快闪存储器装置时的该命令信号的地址信息的一数据内容与一数据类型以及该快闪存储器装置所执行的一数据输入输出操作的一数据类型。
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