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一种I2C总线的Start和Stop识别电路及方法 

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申请/专利权人:江苏帝奥微电子股份有限公司

摘要:本发明公开了一种I2C总线的Start和Stop识别电路及方法,包含第一寄存器F1、第二寄存器F2、锁存器SR、与非门A1、与非门A2、非门I1、非门I2和非门I3和延时器Delay,在信号SCL为低电平时电路不识别Start和Stop,并利用信号SCL作为复位Start和Stop这两个寄存器的输出信号。本发明仅仅使用SDC和SCL这2个信号即可实现Start和Stop的识别,无需使用高速时钟,电路工作时的动态功耗极低并且本发明相对于现有技术采用了不同的方案实现了相似的不用高速时钟即实现Start和Stop的识别的方案,并且本发明寄存器和逻辑门更少,电路结构更加的简单。

主权项:1.一种I2C总线的Start和Stop识别电路,其特征在于:包含第一寄存器F1、第二寄存器F2、锁存器SR、与非门A1、与非门A2、非门I1、非门I2和非门I3和延时器Delay,非门I1的输入端和第二寄存器F2的clk端连接信号SDA,与非门A1的第一输入端和与非门A2的第一输入端连接信号SCL,非门I1的输出端与第一寄存器F1的clk端连接,第一寄存器F1和第二寄存器F2的D端连接电源VDD,第一寄存器F1的Q端连接锁存器SR的S端,锁存器SR的R端与非门I2的输入端、第二寄存器F2的Q端和延时器Delay的一端连接,非门I2的输出端连接与非门A1的第二输入端,与非门A1的输出端连接第一寄存器F1的CLR端,与非门A2的输出端连接第二寄存器F2的CLR端,延时器Delay的另一端连接非门I3的输入端,非门I3的输出端连接与非门A2的第二输入端连接。

全文数据:

权利要求:

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