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申请/专利权人：上海钫铖微电子有限公司

摘要：本申请涉及集成电路技术领域，公开了一种适用于多组多相正交时钟信号之间相位对齐的检测电路及控制方法。该电路包括：第一组逻辑门、第一至第三低通滤波器、反转开关、第一和第二比较器、阈值调节器；第一组逻辑门包括第一和第二或非门、异或门，第一或非门接收第一组多相正交时钟信号中的第一相位时钟信号和第二组多相正交时钟信号中的第二相位时钟信号，第二或非门接收第一组多相正交时钟信号中的第三相位时钟信号和第二组多相正交时钟信号中的第二相位时钟信号，异或门接收第一组多相正交时钟信号中的第二相位时钟信号和第二组多相正交时钟信号中的第二相位时钟信号；第一至第三低通滤波器耦合在各逻辑门的输出；反转开关耦合到第一和第二低通滤波器的输出与第一比较器之间，比较正转和反转时第一和第二低通滤波器的输出信号并分别输出相位偏移比较结果；第二比较器耦合到第三低通滤波器的输出和阈值调节器并输出相移极性比较结果。本申请可以支持高频时钟输入，相位有效鉴别范围为整个时钟周期。

主权项：1.一种适用于多组多相正交时钟信号之间相位对齐的检测电路，其特征在于，包括：第一组逻辑门、第一低通滤波器、第二低通滤波器、第三低通滤波器、反转开关、第一比较器、第二比较器、阈值调节器；所述第一组逻辑门包括第一或非门、第二或非门和异或门，所述第一或非门的两个输入端分别接收第一组多相正交时钟信号中的第一相位时钟信号和第二组多相正交时钟信号中的第二相位时钟信号，所述第二或非门的两个输入端分别接收所述第一组多相正交时钟信号中的第三相位时钟信号和所述第二组多相正交时钟信号中的第二相位时钟信号，所述异或门的两个输入端分别接收所述第一组多相正交时钟信号中的第二相位时钟信号和所述第二组多相正交时钟信号中的第二相位时钟信号，其中所述第一组多相正交时钟信号和所述第二组多相正交时钟信号各自包括顺序的第一至第n相位时钟信号；所述第一低通滤波器、第二低通滤波器和第三低通滤波器分别耦合在所述所述第一或非门、第二或非门和异或门的输出；所述反转开关分别耦合到所述第一低通滤波器和所述第二低通滤波器的输出并分别将正转和反转时所述第一低通滤波器和所述第二低通滤波器的输出信号输入到所述第一比较器的两个输入端，所述第一比较器比较正转和反转时所述第一低通滤波器和所述第二低通滤波器的输出信号并分别输出相位偏移比较结果；所述第二比较器的两个输入端分别耦合到所述第三低通滤波器的输出和所述阈值调节器并输出相移极性比较结果。

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