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摘要：本发明公开了一种数字延迟锁相环及其锁定方法，所述数字延迟锁相环包括：环形振荡模块、分频模块、时钟同步模块、延迟链代码产生模块以及延迟链单元，其中，环形振荡模块用于产生计数时钟；分频模块用于对输入的参考时钟和计数时钟分别进行分频处理，输出分频计数时钟和分频参考时钟；时钟同步模块用于对分频计数时钟和分频参考时钟进行时钟同步处理，输出同步计数时钟和同步参考时钟；延迟链代码产生模块用于产生延迟链控制信号；延迟链单元用于根据延迟链控制信号产生与参考时钟具有预定相位差的输出时钟信号。该数字延迟锁相环可以通过增加控制延迟链代码的位宽而快速提升相位差的分辨率，以满足更高等级的需求。

主权项：1.一种数字延迟锁相环，其特征在于，包括环形振荡模块101、分频模块102、时钟同步模块103、延迟链代码产生模块104以及延迟链单元105，其中，所述环形振荡模块101用于产生计数时钟；所述分频模块102连接所述环形振荡模块101并输入参考时钟，用于对所述参考时钟和所述计数时钟分别进行分频处理，输出分频计数时钟和分频参考时钟；所述时钟同步模块103连接所述分频模块102，用于对所述分频计数时钟和所述分频参考时钟进行时钟同步处理，输出同步计数时钟和同步参考时钟；所述延迟链代码产生模块104连接所述时钟同步模块103，用于通过所述同步计数时钟对所述同步参考时钟进行计数，并根据计数值产生延迟链控制信号；所述延迟链单元105连接所述延迟链代码产生模块104，用于根据所述延迟链控制信号产生与所述参考时钟具有预定相位差的输出时钟信号；所述分频模块102包括第一分频器1021和第二分频器1022，其中，所述第一分频器1021用于对所述参考时钟进行2n1次分频处理，并输出所述分频计数时钟；所述第二分频器1022的输入端连接所述环形振荡模块101的输出端，用于对所述计数时钟进行2n2次分频处理，输出所述分频计数时钟，并且n1n2；所述延迟链代码产生模块104包括计数单元1041、近似滤波代码生成单元1042、代码产生单元1043和控制信号产生单元1044，其中，所述计数单元1041连接所述时钟同步模块103，用于在所述同步参考时钟处于高电平时利用所述同步计数时钟对所述同步参考时钟进行计数，以获得所述同步参考时钟相对于所述同步计数时钟的二进制周期数；所述近似滤波代码生成单元1042连接所述计数单元1041，用于接收所述二进制周期数的部分位宽进行处理，生成二进制进位信号；所述代码产生单元1043连接所述计数单元1041和所述近似滤波代码生成单元1042，用于根据所述二进制周期数和所述二进制进位信号，产生二进制延迟链代码；所述控制信号产生单元1044连接所述代码产生单元1043和所述延迟链单元105，用于根据所述二进制延迟链代码产生延迟链控制信号。

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