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申请/专利权人：此芯科技(无锡)有限公司;此芯半导体设计(上海)有限公司

摘要：本发明提出一种时钟分频电路、片上系统及电子设备，其中，状态控制模块分别与时钟产生逻辑的使能端和第一计数器的使能端连接，第一计数器的输入端用于接入参考时钟信号，第一计数器的输出端连接于时钟产生逻辑的输入端；状态控制模块用于在执行第一类分频系数的分频任务时，向时钟产生逻辑和第一计数器发送使能信号，状态控制模块用于根据第一类分频系数，生成第一类配置指令，并将第一类配置指令下发给第一计数器；第一计数器用于在第一类采样节点对参考时钟信号进行采样，并基于采样结果控制时钟产生逻辑输出第一类分频系数对应的分频时钟信号。通过调节分频系数控制时钟产生逻辑输出任意分频系数对应的分频时钟信号。

主权项：1.一种时钟分频电路，其特征在于，所述时钟分频电路包括：状态控制模块和时钟产生模块，所述时钟产生模块包括时钟产生逻辑和第一计数器；所述状态控制模块分别与所述时钟产生逻辑的使能端和所述第一计数器的使能端连接，所述第一计数器的输入端用于接入参考时钟信号，所述第一计数器的输出端连接于所述时钟产生逻辑的输入端；所述状态控制模块用于在执行第一类分频系数的分频任务时，向所述时钟产生逻辑和所述第一计数器发送使能信号；其中，第一类分频系数为大于1的整数；所述状态控制模块用于根据所述第一类分频系数，生成第一类配置指令，并将所述第一类配置指令下发给所述第一计数器；其中，所述第一类配置指令包括第一类计数周期和第一类采样节点，所述第一类采样节点表示所述第一类计数周期中对所述参考时钟信号进行采样的计数期，当所述第一类分频系数为偶数M时，所述第一类采样节点为第M2个计数期和第M个计数期，当所述第一类分频系数为奇数K时，所述第一类采样节点为第（K+1）2个计数期和第K个计数期，所述第一类计数周期与所述第一类分频系数相等；所述第一计数器用于在所述第一类采样节点对所述参考时钟信号进行采样，并基于采样结果控制所述时钟产生逻辑输出所述第一类分频系数对应的分频时钟信号。

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