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申请/专利权人：成都旋极星源信息技术有限公司
摘要：本发明公开了一种SARADC异步时序控制逻辑电路，涉及集成电路设计技术领域，同时采用了D触发器与D锁存器的方式，能够在SARADC内部产生高速异步时钟及其对应的控制时序逻辑信号，以更短的延时时间使电容性数字模拟转换器电容阵列更快速的完成切换控制逻辑，从而使差分输出信号更快速的稳定，能有效提高SARADC的工作时钟频率，这既能降低信号延时，也能减小芯片面积。
主权项：1.一种SARADC异步时序控制逻辑电路，其特征在于，包括：高速时钟信号生成模块，用于接收外部的差分输入信号，并采用异步时序控制逻辑信号对差分输入信号进行时序控制以及采用异步比较时钟信号驱动动态比较器进行比较之后，采用比较得到的信号获取高速时钟信号；第一位移寄存器模块，用于以所述高速时钟信号为时钟控制信号，采用多级D触发器产生多级第一时序控制逻辑信号；异步比较时钟生成模块，用于以高速时钟信号以及第0级第一时序控制逻辑信号为基础，产生异步比较时钟信号；锁存器模块，用于以多级第一时序控制逻辑信号为基础，采用多级D锁存器产生多级第二时序控制逻辑信号，且多级第一时序控制逻辑信号与多级第二时序控制逻辑信号共同构成异步时序控制逻辑信号；第二位移寄存器模块，用于以多级第二时序控制逻辑信号为基础，采用多级D触发器在采样时钟上升沿进行锁存输出，得到最终输出信号；采样时钟信号输入模块，用于以外部输入的采样时钟信号以及复位信号为基础，产生目标时钟信号，并将目标时钟信号作为第一位移寄存器模块的复位信号以及作为第二位移寄存器模块的时钟控制信号，将外部输入的复位信号作为第二位移寄存器模块的复位信号，从而驱动第一位移寄存器模块产生多级第一时序控制逻辑信号以及驱动第二位移寄存器模块产生输出信号。
全文数据：
权利要求：
百度查询： 成都旋极星源信息技术有限公司 一种SAR ADC异步时序控制逻辑电路
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