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申请/专利权人：珠海博杰电子股份有限公司

摘要：本发明公开了一种PCB板串联测试线控制方法及测试线，控制方法包括获取目标PCB板的多个待测项目；根据多个待测项目的测试时间，确定每个待测项目在第一条件下所需的测试工位数量，第一条件用于表征多个待测项目之间的测试效率达到第一平衡状态；根据待测项目的顺序以及测试工位数量，为多台测试机分配测试任务；在启动测试的情况下，根据每台测试机的测试任务，通过对应的机械手将目标PCB板从上料机构或物料输送线转移到对应的测试机；在测试机完成测试任务的情况下，通过对应的机械手将目标PCB板转移到物料输送线、下料机构或不良品输送线。本发明能够提高PCB板的测试效率。

主权项：1.一种PCB板串联测试线控制方法，应用于PCB板串联测试线，所述PCB板串联测试线包括物料输送线（100）、分别设置在所述物料输送线（100）两端的上料机构（200）和下料机构（300）、安装在所述物料输送线（100）上方的多个机械手（400）、围绕每个所述机械手（400）分布的多个结构相同的测试机（500）以及安装在每个所述机械手（400）工作范围内的不良品输送线（600），其特征在于，所述PCB板串联测试线控制方法包括：获取目标PCB板的多个待测项目；根据所述多个待测项目的测试时间，确定每个所述待测项目在第一条件下所需的测试工位数量，所述第一条件用于表征所述多个待测项目之间的测试效率达到第一平衡状态；在所述测试工位数量之和大于预设的总工位阈值的情况下，根据所述多个待测项目的测试时间，确定每个所述待测项目在第二条件下所需的测试工位数量，所述总工位阈值与所述测试机（500）的数量相适配，所述第二条件用于表征所述多个待测项目之间的测试效率达到第二平衡状态，所述第二平衡状态的效率冗余误差大于所述第一平衡状态的效率冗余误差，所述效率冗余误差用于表征各待测项目之间的合理范围内的测试时间差；根据所述待测项目的顺序以及所述测试工位数量，为多台所述测试机（500）分配测试任务；在启动测试的情况下，根据每台所述测试机（500）的测试任务，通过对应的所述机械手（400）将所述目标PCB板从所述上料机构（200）或所述物料输送线（100）转移到对应的所述测试机（500）；在所述测试机（500）完成测试任务的情况下，通过对应的所述机械手（400）将所述目标PCB板转移到所述物料输送线（100）、所述下料机构（300）或所述不良品输送线（600）。

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