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申请/专利权人：桂林电子科技大学;南宁桂电电子科技研究院有限公司
摘要：本发明提供一种基于HSM的层次化时序模型提取方法，属于集成电路芯片时序模型领域，本发明为解决在芯片设计过程中的数据文件繁琐导致时序分析的准确性和分析效率的问题。所述方法包括：根据获取数字集成电路设计的关键数据并进行识别；生成集成电路的分析环境根据所述的分析环境；针对数字集成电路进行寄生参数的提取并反标到数字集成电路中；提取出超大规模时序模型；对时序库提取出共同类型的时序模型进行合并优化。本申请通过计算并提取模块时序，划分时序接口合并为一个时序模型文件，从而减少时序模型文件的数量。在芯片层次化设计下，可减少工具的运行时间和内存占用、有助于提高布线工具的时序模型设计集成度、减少数字集成电路的设计周期。
主权项：1.一种基于HSM的层次化时序模型提取方法，其特征在于，所述方法包括步骤：在流程设计中采用层次化的设计方法，根据获取数字集成电路设计的关键数据并进行识别，完成信息识别后将信息存储到数据文件；通过脚本获取所述的数字集成电路设计的关键数据，并生成数字集成电路的分析环境；根据所述分析环境，针对数字集成电路进行寄生参数的提取并反标到所述数字集成电路中，为所述数字集成电路的所有端口逻辑打上标签；提取出超大规模时序模型，提取出描述约束或者特殊处理的路径的时序模型；对提取的所述模型的数据文件进行同类型整合。
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权利要求：
百度查询： 桂林电子科技大学 南宁桂电电子科技研究院有限公司 一种基于HSM的层次化时序模型提取方法
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