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摘要：本发明提供了一种用于自动驾驶控制器的域内大数据通信架构,其包括现场可编程逻辑门阵列FPGA、计算单元、SSD存储单元和高稳时钟；计算单元是由至少两个系统芯片SoC通过串接组成，每个系统芯片SoC具有PCIe接口控制器PEU0和PCIe接口控制器PEU1；现场可编程逻辑门阵列FPGA用于完成PCIe接口的参考时钟分配及RootComplex设备和EndPoint设备的电源启动时序控制；SSD存储单元用于数据备份和恢复,同时存储和加载到系统芯片SoC的升级程序；所述高稳时钟连接现场可编程逻辑门阵列FPGA。本发明采用去中心节点的串接互联闭环架构，通过去中心节点引入了冗余和容错机制，增强了通信系统的鲁棒性和容错率，每个节点都与两个相邻节点直接相连，保证了通信的连续性。

主权项：1.一种用于自动驾驶控制器的域内大数据通信架构,其特征在于:所述通信架构包括现场可编程逻辑门阵列FPGA、计算单元、SSD存储单元和高稳时钟；所述计算单元是由至少两个系统芯片SoC通过串接组成，每个系统芯片SoC具有PCIe接口控制器PEU0和PCIe接口控制器PEU1；所述计算单元中，相邻所述系统芯片SoC之间以及首端和末端的两个所述系统芯片SoC之间，均通过PCIe接口控制器PEU0和PCIe接口控制器PEU1建立PCIe链路；所述现场可编程逻辑门阵列FPGA用于完成PCIe接口的参考时钟分配以及RootComplex设备和EndPoint设备的电源启动时序控制；所述SSD存储单元用于与其连接的所述系统芯片SoC的数据备份和恢复，确保在所述系统芯片SoC出现故障或需要重新启动时，可迅速恢复到正常状态，同时存储和加载到所述系统芯片SoC的升级程序，以实现性能优化和功能扩展；所述系统芯片SoC通过PCIe接口控制器PEU0配置为RootComplex设备与所述SSD存储单元连接以建立PCEe链路；所述高稳时钟连接所述现场可编程逻辑门阵列FPGA,其生成的时钟信号用于驱动所述现场可编程逻辑门阵列FPGA内部的各逻辑电路和时钟管理模块；所述高稳时钟接入所述现场可编程逻辑门阵列FPGA后，由所述现场可编程逻辑门阵列FPGA通过锁相环实现时钟信号倍频并输出所述系统芯片SoC和SSD存储单元所需的PCIe接口参考时钟，所述系统芯片SoC和SSD存储单元参考时钟稳定且在允许的波动范围内后，所述现场可编程逻辑门阵列FPGA开始对所述系统芯片SoC和SSD存储单元的上电启动时序进行管理；RootComplex设备通过管理EndPoint设备的复位信号来控制EndPoint设备的启动过程，以保证当EndPoint设备启动时RootComplex设备已经准备好进行PCIe链路初始化，RootComplex设备负责控制PERST#复位信号线；在RootComplex设备的电源和参考时钟稳定之后，RootComplex设备释放EndPoint设备的复位信号，此时EndPoint设备开始启动。

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百度查询： 湖北汽车工业学院 一种用于自动驾驶控制器的域内大数据通信架构