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摘要：本发明公开了一种基于脉宽扩展单元的n倍脉宽扩展电路及其锁相环，这个n倍脉宽扩展电路包括：脉宽传递序列、脉宽扩展组、或逻辑组和输出整形单元；脉宽传递序列包括n‑1个级联的D触发器；脉宽扩展组包括n‑1个脉宽扩展单元，脉宽扩展单元包括一个双输入端的或逻辑单元和一个延时单元，延时单元的信号输入端和信号输出端分别与双输入端的信号输入端连接；或逻辑组包括一个多输入端的或逻辑单元或多个或逻辑单元；输出整形单元包括一个D触发器D_0。本发明简化了脉宽扩展电路的电路结构，降低脉宽扩展电路的生产成本，提高脉宽扩展效率，提高锁相环中数据传输速度和稳定性。
主权项：1.一种基于脉宽扩展单元的n倍脉宽扩展电路，其特征在于，所述基于脉宽扩展单元的n倍脉宽扩展电路包括：脉宽传递序列、脉宽扩展组、或逻辑组和输出整形单元；脉宽传递序列，包括n-1个级联的D触发器；脉宽扩展组，包括n-1个脉宽扩展单元，每一个脉宽扩展单元包括一个双输入端的或逻辑单元和一个延时单元，延时单元的信号输入端和延时单元的信号输出端分别与双输入端的或逻辑单元的信号输入端连接；或逻辑组，包括一个多输入端的或逻辑单元；输出整形单元，包括一个D触发器（D_0）；其中，参考时钟信号（Clk）从脉宽传递序列的第n-1级D触发器（D_n-1）的时钟信号输入端输入，脉宽传递序列的n-1个级联的D触发器的信号输入端与脉宽扩展组的n-1个脉宽扩展单元的信号输入端对应连接，脉宽扩展组的信号输出端与或逻辑组的信号输入端连接，或逻辑组的信号输出端与输出整形单元的信号输入端连接；n是大于或等于2的整数；其中，所述或逻辑组包括一个多输入端的或逻辑单元，所述脉宽扩展组的信号输出端与或逻辑组的信号输入端连接是指n-1个脉宽扩展组的双输入端的或逻辑单元的信号输出端与或逻辑组的多输入端的或逻辑单元的信号输入端对应连接；其中，当一个多输入端的或逻辑单元难以快速完成n-1个信号的或逻辑运算，可适应性增加或逻辑单元的数量，通过多个或逻辑单元的组合使用，以实现对所有输入信号执行或逻辑运算并输出一个结果信号的功能。
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