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申请/专利权人:电子科技大学
摘要:针对如今集成电路工艺尺寸不断缩小以及数字电路的高速发展,对ADC速度要求越来越高同时小尺寸工艺导致失调电压严重的问题,提出了一种用于SARADC的高速低失调比较器电路。对于传统的单比较器结构,其复位所浪费的时间对于高速ADC来说是致命的,同时小尺寸工艺带来的高失调电压对于SARADC来说是很难容忍的,所以本发明提出的交替比较器结构能够很好的解决单比较器复位所消耗的时间并加以利用提高ADC工作速度,同时引入的辅助输入管和电荷泵结构对比较器输入失调电压动态调整来解决小尺寸工艺下引入的高失调电压。
主权项:1.一种用于SARADC的高速低失调比较器电路,该电路包括了前后级正反馈动态比较器、比较器失调电压校准电路和交替比较器控制逻辑电路,其特征在于:动态比较器在前级预放大过程中引入PMOS管M5、M6提高正反馈;比较器失调电压校准电路在校准过程中引入PMOS管M17、M19和NMOS管M16、M18形成电流转换电路来消除电荷泵电路每次充放电电流重新建立消耗的时间;交替比较器控制逻辑电路引入逻辑门NOT3、NOT2、AND4对采样时钟CLK产生窄脉冲来激活交替比较器控制逻辑电路开始工作,利用采样时钟CLK控制开关SW2和SW4、采样时钟的反相CLKB控制开关SW1和SW3、MOS管M1、M2、M3和M4以及逻辑门ADN1和AND3保证比较器电路的交替工作和复位,引入逻辑门AND2和其控制信号CMPOK保证比较器完成最后一次比较后能够停止工作。
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百度查询: 电子科技大学 一种用于SAR ADC的高速低失调比较器电路
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