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申请/专利权人：上海安路信息科技股份有限公司
摘要：本发明提供一种PCIe系统的时钟电路及其时序控制方法，包括：用户侧寄存器；PCIe硬核，包括硬核寄存器；硬核寄存器以PCIe硬核从串行器接收的驱动时钟作为时钟信号；时钟优化模块，包括锁相环电路和全局时钟网络；锁相环电路将PCIe硬核输出的驱动时钟作为参考时钟，输出同频同相的信号；全局时钟网络将锁相环电路输出的信号作为时钟信号输入至用户侧寄存器。通过锁相环电路能够保证全局时钟网络输出给用户侧寄存器的时钟信号与PCIe硬核从串行器接收的驱动时钟的频率和相位相同，从而不仅有效减小了硬核寄存器的时钟信号和用户侧寄存器时钟信号之间的时钟偏斜，还有利于时钟路径的时序收敛，解决了现有PCIe系统的时钟电路时钟偏斜较大、时序收敛困难的问题。
主权项：1.一种PCIe系统的时钟电路，其特征在于，包括：用户侧寄存器；PCIe硬核，包括硬核寄存器；所述硬核寄存器以所述PCIe硬核从串行器接收的驱动时钟作为时钟信号；时钟优化模块，包括锁相环电路和全局时钟网络；所述锁相环电路用于将所述PCIe硬核从串行器接收的驱动时钟作为参考时钟，输出与参考时钟同频同相的信号；所述全局时钟网络用于将所述锁相环电路输出的信号作为时钟信号输入至所述用户侧寄存器。
全文数据：
权利要求：
百度查询： 上海安路信息科技股份有限公司 PCIe系统的时钟电路及其时序控制方法
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