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申请/专利权人：深圳大学

摘要：本发明涉及一种多分幅超快CMOS图像传感器，包括：电压控制延迟模块，电压控制延迟模块用于对控制电压信号进行延时处理后，输出多路曝光驱动信号；快下降沿数字缓冲模块，快下降沿数字缓冲模块与电压控制延迟模块连接，用于接收多路曝光驱动信号并对多路曝光驱动信号进行缓冲处理；像素模块，像素模块用于接收经过快下降沿数字缓冲模块缓冲处理的多路曝光驱动信号，利用四个相邻的像素组成一个四分幅像素以根据多路曝光驱动信号进行曝光生成四分幅图像。本发明通过电压控制延迟模块进行电压控制以获得多路曝光驱动信号，采用原位分像素的分幅方案，从而使得像素模块可以生成多幅图像，进而使得该CMOS图像传感器可以实现多幅成像。

主权项：1.一种多分幅超快CMOS图像传感器，其特征在于，包括：电压控制延迟模块，所述电压控制延迟模块用于对控制电压信号进行延时处理后，输出多路曝光驱动信号；所述电压控制延迟模块包括：多路电压控制延迟电路；每一路所述电压控制延迟电路包括：多个依次串联的设置的电压控制延迟器、且相邻两个电压控制延迟器之间设置一个反相器；每一路所述电压控制延迟电路输出一路曝光驱动信号；所述电压控制延迟模块包括：第一电压控制延迟电路、第二电压控制延迟电路、第三电压控制延迟电路以及第四电压控制延迟电路；所述控制电压信号包括：第一控制信号和第二控制信号；所述第一电压控制延迟电路、所述第二电压控制延迟电路、所述第三电压控制延迟电路分别接收所述第一控制信号，并分别对所述第一控制信号进行延时处理后，分别输出对应的第一曝光驱动信号、第二曝光驱动信号、第三曝光驱动信号；所术第四电压控制延迟电路接收所述第二控制信号，并对所述第二控制信号进行延时处理后，输出第四曝光驱动信号；快下降沿数字缓冲模块，所述快下降沿数字缓冲模块与所述电压控制延迟模块连接，用于接收所述多路曝光驱动信号并对所述多路曝光驱动信号进行缓冲处理；所述快下降沿数字缓冲模块包括：与所述多路电压控制延迟电路对应设置的多个快下降沿数字缓冲器；每一个所述快下降沿数字缓冲器的输入端与其对应设置的电压控制延迟电路的输出端连接，以对所接入的曝光驱动信号进行缓冲处理；像素模块，所述像素模块用于接收经过所述快下降沿数字缓冲模块缓冲处理的多路曝光驱动信号，利用四个相邻的像素组成一个四分幅像素以根据所述多路曝光驱动信号进行曝光生成四分幅图像；所述像素模块包括：多个像素单元电路；每一个所述像素单元电路与对应的快下降沿数字缓冲器连接，以接收经过所述快下降沿数字缓冲器缓冲处理后的曝光驱动信号，并根据所接收的曝光驱动信号进行曝光以生成对应的图像；所述多个像素单元电路共用一个复位驱动信号，且所述多个像素单元电路共用一个选通驱动信号；所述像素模块包括：第一像素单元电路、第二像素单元电路、第三像素单元电路和第四像素单元电路；所述快下降沿数字缓冲模块包括：第一快下降沿数字缓冲器、第二快下降沿数字缓冲器、第三快下降沿数字缓冲器和第四快下降沿数字缓冲器；所述第一像素单元电路与所述第一快下降沿数字缓冲器连接，以接收经过所述第一快下降沿数字缓冲器缓冲处理后的第一曝光驱动信号；所述第二像素单元电路与所述第二快下降沿数字缓冲器连接，以接收经过所述第二快下降沿数字缓冲器缓冲处理后的第二曝光驱动信号；所述第三像素单元电路与所述第三快下降沿数字缓冲器连接，以接收经过所述第三快下降沿数字缓冲器缓冲处理后的第三曝光驱动信号；所述第四像素单元电路与所述第四快下降沿数字缓冲器连接，以接收经过所述第四快下降沿数字缓冲器缓冲处理后的第四曝光驱动信号。

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