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申请/专利权人：深圳市合信自动化技术有限公司
摘要：本发明提供一种可配置总线解决传输延时数据出错的装置，包括同步时钟发生器和总线同步时钟占空比调节器；同步时钟发生器产生时钟信号，并结合配置参数，对时钟信号预置的总线时钟周期进行倍缩，使时钟信号的总线时钟周期内均形成有与配置参数等同数目的时钟步长；总线同步时钟占空比调节器接收同步时钟发生器输出的时钟信号，且结合步长调整参数，对所接收时钟信号的总线时钟周期内的时钟步长进行删减后更新，得到总线时钟周期更新后的时钟信号并加载于总线上；其中，步长调整参数小于配置参数。实施本发明，在不降低总线频率的前提下，通过调节总线频率的占空比来确保找到传输延时更长的模块，从而解决传输延时所带来的数据出错的问题。
主权项：1.一种可配置总线解决传输延时数据出错的装置，用于总线上，其特征在于，包括相互连接的同步时钟发生器和总线同步时钟占空比调节器；其中，所述同步时钟发生器，用于产生时钟信号，并进一步结合用户输入的配置参数，对所述时钟信号预置的总线时钟周期进行倍缩，使所述时钟信号在每一预置的总线时钟周期内均形成有与所述配置参数等同数目的时钟步长；所述总线同步时钟占空比调节器与所述总线相连，用于接收所述同步时钟发生器输出的时钟信号，且进一步结合用户输入的步长调整参数，对所接收的时钟信号上每一预置的总线时钟周期内所形成的时钟步长均进行删减之后更新，得到总线时钟周期更新后的时钟信号并加载于所述总线上；其中，所述步长调整参数小于所述配置参数。
全文数据：
权利要求：
百度查询： 深圳市合信自动化技术有限公司 一种可配置总线解决传输延时数据出错的方法、装置及PLC
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