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逐次比较型A/D转换器 

申请/专利权人:罗姆股份有限公司

申请日:2022-11-28

公开(公告)日:2024-06-21

公开(公告)号:CN118235330A

主分类号:H03M1/38

分类号:H03M1/38;H03M1/10;H03M1/46

优先权:["20211221 JP 2021-207455"]

专利状态码:在审-公开

法律状态:2024.06.21#公开

摘要:SARADC100A具有冗余性。模拟部110对模拟输入电压VIN进行采样,生成表示与控制码DAC对应的阈值电压和模拟输入电压VIN的大小关系的比较信号COMP。逻辑部130A在第i个i≧1周期中,生成对第i个周期的控制码DACi加上第i+1个周期的权重wi+1而得到的第1值Ai+1以及从第i个周期的控制码DACi减去第i+1个周期的权重wi+1而得到的第2值Bi+1。逻辑部130A在第i个周期的比较信号COMPi确定时,将第1值Ai+1和第2值Bi+1中的与比较信号对应COMPi的一方作为第i+1个周期的控制码DACi+1供给到模拟部110。

主权项:1.一种逐次比较型AD转换器,是将模拟输入电压转换为数字输出的具有冗余性的逐次比较型AD转换器,包括:模拟部,其对所述模拟输入电压进行采样,生成表示与控制码对应的阈值电压和所述模拟输入电压的大小关系的比较信号,以及逻辑部,其根据各周期的所述比较信号,生成下一个周期的所述控制码;所述逻辑部在第i个i≧1周期中,生成对第i个周期的所述控制码加上第i+1个周期的权重而得到的第1值以及从所述第i个周期的所述控制码减去第i+1个周期的权重而得到的第2值,在第i个周期的比较信号确定时,将所述第1值和所述第2值中的与所述比较信号对应的一者作为第i+1个周期的所述控制码供给到所述模拟部。

全文数据:

权利要求:

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