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申请/专利权人：中电海康集团有限公司

摘要：本发明公开了一种基于神经形态器件的逻辑门，包括第一神经元、第二神经元、第三神经元、第四神经元和第五神经元，第一神经元与第三神经元连接，第二神经元与第四神经元连接，第三神经元和第四神经元均与第五神经元连接；第一神经元和第二神经元，膜电位大于等于第一发放阈值时，输出高电平，否则，输出低电平；第三神经元和第四神经元，具有一基本信号，膜电位为基本信号和输入信号之和，且大于等于第二发放阈值时，输出高电平，否则，输出低电平；第五神经元，膜电位为两个输入信号之和，在大于等于第三发放阈值时，输出高电平，否则，输出低电平。本发明可实现不同逻辑功能转换，具有低功耗和不应期性能，与神经网络的融合度和适用性好。

主权项：1.一种基于神经形态器件的逻辑门，其特征在于：所述基于神经形态器件的逻辑门包括第一神经元A、第二神经元B、第三神经元C、第四神经元D和第五神经元Y，所述第一神经元A与第三神经元C连接，所述第二神经元B与第四神经元D连接，所述第三神经元C和第四神经元D均与第五神经元Y连接，所述第一神经元A和第二神经元B为信号输入端，所述第五神经元Y为信号输出端，其中：所述第一神经元A和第二神经元B均为第一类神经元，其在接收到信号时，当膜电位大于等于第一发放阈值，输出高电平，当膜电位小于第一发放阈值，输出低电平；所述第三神经元C和第四神经元D均为第二类神经元，其具有一个基本信号，且膜电位为基本信号和来自对应神经元的输入信号之和，在膜电位大于等于第二发放阈值时，输出高电平，在膜电位小于第二发放阈值时，输出低电平；所述第五神经元Y为第三类神经元，其膜电位为来自所述第三神经元C和第四神经元D的输入信号之和，在膜电位大于等于第三发放阈值时，输出高电平，在膜电位小于第三发放阈值时，输出低电平；所述第一神经元A和第二神经元B均为抑制性神经元，在输出高电平时通过发放抑制信号抑制其所连神经元的激活，所述第三神经元C和第四神经元D具有恒1的一个基本信号；所述基于神经形态器件的逻辑门为或非门，并执行如下操作：当所述第一神经元A和第二神经元B均输出高电平时，所述第三神经元C和第四神经元D被抑制，膜电位小于所述第二发放阈值，输出低电平，所述第五神经元Y的膜电位小于所述第三发放阈值，输出低电平；当所述第一神经元A输出高电平，所述第二神经元B输出低电平时，所述第三神经元C被抑制，膜电位小于所述第二发放阈值，输出低电平，所述第四神经元D未被抑制，膜电位大于等于所述第二发放阈值，输出高电平，所述第五神经元Y的膜电位小于所述第三发放阈值，输出低电平；当所述第一神经元A输出低电平，所述第二神经元B输出高电平时，所述第三神经元C未被抑制，膜电位大于等于所述第二发放阈值，输出高电平，所述第四神经元D被抑制，膜电位小于所述第二发放阈值，输出低电平，所述第五神经元Y的膜电位小于所述第三发放阈值，输出低电平；当所述第一神经元A和第二神经元B均输出低电平时，所述第三神经元C和第四神经元D未被抑制，膜电位大于等于所述第二发放阈值，输出高电平，所述第五神经元Y的膜电位大于等于所述第三发放阈值，输出高电平；所述基于神经形态器件的逻辑门为与非门，并执行如下操作：当所述第一神经元A和第二神经元B均输出高电平时，所述第三神经元C和第四神经元D被抑制，膜电位小于所述第二发放阈值，输出低电平，所述第五神经元Y的膜电位小于所述第三发放阈值，输出低电平；当所述第一神经元A输出高电平，所述第二神经元B输出低电平时，所述第三神经元C被抑制，膜电位小于所述第二发放阈值，输出低电平，所述第四神经元D未被抑制，膜电位大于等于所述第二发放阈值，输出高电平，所述第五神经元Y的膜电位大于等于所述第三发放阈值，输出高电平；当所述第一神经元A输出低电平，所述第二神经元B输出高电平时，所述第三神经元C未被抑制，膜电位大于等于所述第二发放阈值，输出高电平，所述第四神经元D被抑制，膜电位小于所述第二发放阈值，输出低电平，所述第五神经元Y的膜电位大于等于所述第三发放阈值，输出高电平；当所述第一神经元A和第二神经元B均输出低电平时，所述第三神经元C和第四神经元D未被抑制，膜电位大于等于所述第二发放阈值，输出高电平，所述第五神经元Y的膜电位大于等于所述第三发放阈值，输出高电平。

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