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申请/专利权人：长春长光辰芯微电子股份有限公司;杭州长光辰芯微电子有限公司

摘要：本发明提供一种双斜坡双沿向下计数模数转换装置及其转换方法，其中的装置包括斜坡发生器、比较器、高速时钟、低速时钟、数字逻辑电路和数据处理器；斜坡发生器用于产生斜率相同且方向相反的两个斜坡信号；将像素信号和两个斜坡信号输入到比较器的两个输入端，数字逻辑电路根据比较器的输出信号、高速时钟和低速时钟计算出低速和高速时钟计数脉冲，还根据高速时钟与高速时钟脉冲控制信号计算出额外位计数脉冲，分别输入到高位计数器、低位计数器、额外位计数器进行向下计数；数据处理器根据高位计数器、低位计数器、额外位计数器的计数值计算出像素信号电压的量化数值。本发明可降低斜坡发生器复位时的功耗及计数器的设计复杂度。

主权项：1.一种双斜坡双沿向下计数模数转换装置，其特征在于，包括斜坡发生器、比较器、高速时钟、低速时钟、数字逻辑电路、高位计数器、低位计数器、额外位计数器和数据处理器；其中，所述斜坡发生器用于产生斜率绝对值相同且方向相反的第一斜坡信号和第二斜坡信号；将图像传感器输出的像素信号和所述比较器产生的第一斜坡信号和第二斜坡信号分别作为所述比较器的两路输入信号，将所述比较器的输出信号与所述高速时钟、所述低速时钟分别送入所述数字逻辑电路；所述数字逻辑电路利用所述低速时钟的下降沿和所述高速时钟的上升沿分别对所述第一斜坡信号和所述第二斜坡信号的局部时间段进行采样得到高位计数使能和低位计数使能，并对所述高位计数使能与所述低速时钟进行逻辑与操作得到低速时钟计数脉冲，对所述低位计数使能与所述高速时钟进行逻辑与操作得到高速时钟计数脉冲；所述数字逻辑电路还利用所述高速时钟的上升沿和下降沿对与所述低位计数使能同步的高速时钟脉冲控制信号进行采样得到两个额外位计数使能，对两个额外位计数使能进行逻辑与运算得到额外位计数脉冲；所述高位计数器用于对所述高速时钟计数脉冲进行向下计数，并将计数值传输至所述数据处理器；所述低位计数器用于对所述低速时钟计数脉冲进行向下计数，并将计数值传输至所述数据处理器；所述额外位计数器用于对所述额外位计数脉冲进行向下计数，并将计数值传输至所述数据处理器；所述数据处理器用于根据公式2*a+Nb+c计算得到像素信号电压的量化数值；其中，a为所述高位计数器输出的计数值，b为所述低位计数器输出的计数值，c为所述额外位计数器输出的计数值，N为所述高速时钟的频率与所述低速时钟的频率之比。

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