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申请/专利权人：电子科技大学

摘要：本发明公开了一种示波器的数字化高低频抑制触发方法，先通过串并转换将ADC采样数据降速至FPGA时钟频率，获取到N路并行数据，再设计并行CIC滤波器进行抗混叠抽取，将N路数据转换为串行数据。设计串行CIC滤波器对串行数据进行高倍率抽取，以降低后级滤波器设计难度。利用MATLAB产生所需的FIR低通滤波器系数并送入FPGA中的滤波器，对串行抽取后的信号进行滤波，并将滤除高频成分的信号送入触发模块，实现高频抑制。将抗混叠抽取后的信号与通过低通滤波器的信号作差，获取到信号的高频成分送入触发模块，实现低频抑制。用户可以通过上位机控制数据选择器实现高频抑制或低频抑制。

主权项：1.一种示波器的数字化高低频抑制触发方法，其特征在于，包括以下步骤：1、设置示波器的相关参数；设示波器的系统采样率为f，FPGA时钟频率为f1；2、数据采集；数据接收模块接收ADC采样的高速数据流降速并降速至FPGA的时钟域内，获取到路并行采样数据，记为：{y1n,y2n,…,yNn}，n＝0,1,2,…；3、数据预处理；3.1、设计W级、抽取倍数为N、延迟因子为M的并行CIC滤波器，其传递函数为： 其中，z表示Z域；3.2、将并行采样数据{y1n,y2n,…,yNn}送入并行CIC滤波器进行N倍抗混叠抽取滤波，从而将N路并行数据转换为串行数据ywn；3.3、设计K级、抽取倍数为R、延迟因子为M的串行CIC滤波器，其传递函数为： 3.4、对串行数据ywn进行R倍抗混叠抽取滤波，得到ykn＝ywRn；3.5、将抗混叠串行抽取后的采样数据ykn分成两路，一路输入至高频抑制模块，进入步骤4，另一路输入至低频抑制模块，进入步骤5；4、示波器的高频抑制；4.1、设置高频抑制的通带截止频率fp和阻带截止频率fc；4.2、根据通带截止频率fp和阻带截止频率fc设计对应的FIR低通滤波器系数；4.3、将FIR低通滤波器系数转换为定点数，然后下发到FPGA中的滤波器；4.4、通过FPGA中的滤波器对抗混叠串行抽取后的采样数据ykn进行滤波处理，得到低频数据yen；5、示波器的低频抑制；将抗混叠串行抽取后的采样数据ykn与高频抑制模块输出的低频数据yen输入至减法器，获取高频数据yhn；yhn＝ykn-yen6、高低频抑制选择；通过上位机下发控制信号，控制数据选择器输出低频数据或高频数据并送入数字触发模块，从而实现高频或低频抑制触发。

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百度查询： 电子科技大学 一种示波器的数字化高低频抑制触发方法