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申请/专利权人：武汉中观自动化科技有限公司
摘要：本发明公开一种基于FPGA实现的快速排序方法及装置，所述方法包括：将n个待排序数据组成一个待排序数列写入RAM存储；将待排序数列划分成大小为m的多个数据块；从RAM中读取一个数据块中的待排序数据，分别存储至m个寄存器中；例化m个比较单元，在每个比较单元中，将对应的寄存器中的待排序数据分别与RAM中待排序数列的每个待排序数据作比较，计算待排序数列中小于大于对应的寄存器中的待排序数据的数据个数，得到待排序数据在在待排序数列中以升序降序进行排列后的序号；综合所有比较单元计算的序号，得到一个数据块中待排序数据的排序结果；重复以上排序过程，得到待排序数列的排序结果。本发明结合RAM实现数据的排序，减少了FPGA资源消耗。
主权项：1.一种基于FPGA实现的快速排序方法，其特征在于，所述方法包括：S1、将n个待排序数据组成一个待排序数列写入RAM存储，记录每个待排序数据的地址；将待排序数列划分成多个数据块；S2、从RAM中读取一个数据块中的待排序数据，分别存储至多个寄存器中；S3、例化多个比较单元，将各个寄存器中的待排序数据分别作为各个比较单元的第一输入，根据待排序数据的地址依次读取RAM中的各个待排序数据分别作为各个比较单元的第二输入；S4、在每个比较单元中，将对应的寄存器中的待排序数据分别与RAM中待排序数列的每个待排序数据作比较，计算待排序数列中小于大于对应的寄存器中的待排序数据的数据个数，将所述数据个数作为对应的寄存器中的待排序数据在在待排序数列中以升序降序进行排列后的序号；综合所有比较单元计算的序号，完成一个数据块中的待排序数据的排序；S5、重复步骤S2～S4，得到待排序数列的排序结果。
全文数据：
权利要求：
百度查询： 武汉中观自动化科技有限公司 一种基于FPGA实现的快速排序方法及装置
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