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申请/专利权人：电子科技大学
摘要：本发明提出一种多路并行跳时信号延时对齐及检测方法，属于跳时通信系统的检测处理技术领域。包括如下步骤：步骤S1：构造个双口RAM核，形成双口RAM环形缓冲空间；步骤S2：依据跳时信号的跳时间隔，装载双口RAM的初始主读地址，通过对读写地址的控制实现跳时信号的对齐；步骤S3：利用滑动互相关进行相关结果的计算，将相关结果与门限值比较完成定时同步检测。本发明具有灵活的延时时长参数可调特性，由于延时网络实现了流水线处理，搭配滑动互相关同步检测算法，能够极大地提高跳时接收机的吞吐量且FPGA资源消耗较小。
主权项：1.一种多路并行跳时信号延时对齐及检测方法，其特征在于，包括如下步骤：步骤S1：构造个双口RAM核，形成双口RAM环形缓冲空间；步骤S2：依据跳时信号的跳时间隔，装载双口RAM的初始主读地址，通过对读写地址的控制实现跳时信号的延时对齐；步骤S3：利用滑动互相关进行相关结果的计算，将相关结果与门限值比较完成定时同步检测。
全文数据：
权利要求：
百度查询： 电子科技大学 一种多路并行跳时信号延时对齐及检测方法
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