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申请/专利权人：珠海全志科技股份有限公司;华南理工大学
摘要：本发明涉及智能化控制技术领域，公开了应用于SoC系统的CPU访存优化控制方法及系统，包括：当CPU触发第一访存命令时，访存直通模块根据存储器支持的协议对第一访存命令执行格式转换操作得到第二访存命令并提供给综合仲裁模块，综合仲裁模块对第二访存命令进行仲裁并根据仲裁结果将第二访存命令发送至存储器，以便于存储器响应第二访存命令。可见，本发明在访存架构中优化了CPU的访存路径，通过访存直通模块将CPU触发的访存命令进行协议转换之后直接参与发送至存储器之前的最后一步仲裁，不再参与打包以及与其他主机之间的仲裁操作，这样能够有效减小SoC系统中CPU的访存延时，以进一步提高CPU的性能。
主权项：1.一种应用于SoC系统的CPU访存优化控制方法，其特征在于，所述SoC系统至少包括预先构建好的访存架构，所述访存架构至少包括综合仲裁模块以及CPU对应的访存直通模块，所述访存架构至少用于实现所述CPU面向目标存储器的数据访存操作，所述方法包括：当所述CPU触发第一访存命令时，所述访存直通模块根据所述目标存储器所支持的第一协议对所述第一访存命令执行格式转换操作得到所述第一协议所支持的第二访存命令，并将所述第二访存命令提供给所述综合仲裁模块，所述第二访存命令的操作类型与所述第一访存命令的操作类型相同；所述综合仲裁模块在接收到所述第二访存命令之后，对所述第二访存命令进行仲裁，得到所述第二访存命令对应的第一仲裁结果，并根据所述第一仲裁结果将所述第二访存命令发送至所述目标存储器，以触发所述目标存储器响应所述第二访存命令。
全文数据：
权利要求：
百度查询： 珠海全志科技股份有限公司 华南理工大学 应用于SoC系统的CPU访存优化控制方法及系统
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