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申请/专利权人：南京宁麒智能计算芯片研究院有限公司

摘要：本发明公开一种FFT处理器，属于数字信号处理技术领域。针对现有技术中存在的流水型架构硬件实现的FFT算法资源消耗大，递归型架构性能不高，现有技术无法解决FFT算法硬件实现性能和功耗同时满足的问题，本发明提供一种FFT处理器，包括顶层控制模块、数据索引模块、旋转因子索引模块和蝶形运算单元模块，顶层控制模块控制运算，数据索引模块对数据SRAM进行寻址，旋转因子索引模块对旋转因子SRAM进行寻址，蝶形运算单元模块根据顶层控制模块的信息重构运算单元进行蝶形运算，该处理器能够支持FFTIFFT批处理运算，与传统FFT处理器相比，提高硬件资源的利用率，在保证高性能的基础上兼具低功耗的特点。

主权项：1.一种FFT处理器，其特征在于，包括顶层控制模块、数据索引模块、旋转因子索引模块和蝶形运算单元模块，顶层控制模块与数据索引模块、旋转因子索引模块和蝶形运算单元模块均连接，蝶形运算单元模块与数据索引模块和旋转因子索引模块均连接；顶层控制模块控制运算，数据索引模块对数据SRAM进行寻址，旋转因子索引模块对旋转因子SRAM进行寻址，蝶形运算单元模块根据顶层控制模块的信息重构运算单元进行蝶形运算；旋转因子索引模块检测到旋转因子的偏移地址为0时，不对旋转因子SRAM进行读数据操作，直接生成旋转因子的结果；蝶形运算单元模块在执行非最后一级FFT运算时，若检测到旋转因子的值为1，复加复减运算后的结果不输入复乘器与旋转因子相乘，输入寄存器寄存；蝶形运算单元模块在执行最后一级FFT运算时，复加复减运算后的结果不与旋转因子相乘，直接输出；蝶形运算单元模块执行基2运算时，包括两个复数加法器、一个复数乘法器和一个寄存单元；第一路复数加法器和第二路复数加法器的输入端连接不同的数据源，第一路复数加法器的输出端与寄存单元连接，第二路复数加法器的输出端与复数乘法器的输入端连接，复数乘法器的输入端还与旋转因子索引模块的输出端连接；蝶形运算单元模块包括八个复数加法器和四个复数乘法器重构成四个基2蝶形运算单元，实现八路并行计算；蝶形运算单元模块执行基4运算时，包括八个复数加法器、三个复数乘法器、一个中间寄存单元和一个寄存单元；八个复数加法器分为两级，第一级复数加法器和第二级复数加法器通过中间寄存单元相连；第二级的第一路复数加法器的输出端与寄存单元相连，第二级的第二、三、四路复数加法器的输出端分别与第一、第二、第三路复数乘法器的输入端连接，第一、第二、第三路复数乘法器的输入端还都与旋转因子连接。

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