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申请/专利权人：北京时代民芯科技有限公司;北京微电子技术研究所

摘要：本发明公开了一种基于代码混淆技术的Verilog源码保护系统和方法，该系统包括：迭代仲裁器，用于将接收到的Verilog源码逐行输入到词法分析器中；将收到的混淆模式向下传递至仲裁器；词法分析器，用于对Verilog源码中的代码进行分析分类后输出；仲裁器，用于以混淆模式作为参考信息，对标识符进行仲裁后输出；随机混淆器，用于对标识符进行随机混淆处理后输出；格式处理器，用于对所有输入信息进行布局混淆处理后输出；输出器，用于输出混淆后的Verilog代码。本发明能够以很低的复杂度完成大规模Verilog硬件代码的混淆处理，实现对代码的加密处理，可实现对Verilog源码的模块名、输入输出信号、寄存器和连线等信息的隐藏，进而实现对Verilog源代码知识产权的保护。

主权项：1.一种基于代码混淆技术的Verilog源码保护系统，其特征在于，包括：迭代仲裁器，用于接收Verilog源码和混淆模式的输入；将Verilog源码逐行输入到词法分析器中；将混淆模式向下传递至仲裁器，作为仲裁的参考信息；以及，对词法分析器输入的宏定义体进行递归处理；词法分析器，用于按照Verilog语言的命名规则对Verilog源码中的代码进行分析，将代码按照宏定义体、标识符和函数任务进行分类；针对不同的分类采用不同的处理方式进行处理：将宏定义体输出到迭代仲裁器中进行处理，将标识符输出到仲裁器中进行处理，将函数任务输出到格式处理器中进行处理；仲裁器，用于以混淆模式作为参考信息，判断输入的标识符所属的保留模式；若属于全部保留模式，则将标识符输入至格式处理器中进行处理；若属于部分保留模式、且属于需要保留的模块范围，则将标识符输入至格式处理器中进行处理；若属于部分保留模式、且不属于需要保留的模块范围，则将标识符输入至随机混淆器中进行处理；若属于无保留模式，则将标识符输入至随机混淆器中进行处理；随机混淆器，用于对输入的标识符进行随机混淆处理，输出随机混淆处理后的标识符；格式处理器，用于对所有输入信息进行布局混淆处理，得到混淆后的Verilog代码；输出器，用于输出混淆后的Verilog代码。

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