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申请/专利权人：爱思开海力士有限公司
摘要：一种错误校正码ECC解码器包括校验子计算块和路径控制器。校验子计算块被配置成执行用于从码字生成校验子的校验子计算。路径控制器被配置成输出经由第一路径至第三路径传送的数据。第一路径是用于在检测到没有错误时将码字传送到路径控制器的路径。第二路径包括单个错误解码逻辑电路，并且单个错误解码逻辑电路校正码字的单个错误以将被校正的码字经由第二路径传送到路径控制器。第三路径包括多个错误解码逻辑电路，并且多个错误解码逻辑电路校正码字的至少两个错误以将被校正的码字传送到路径控制器。
主权项：1.一种错误校正码ECC解码器，包括：校验子计算块，被配置成执行用于从码字生成校验子的校验子计算以及输出所述校验子；以及路径控制器，被配置成输出经由第一路径、第二路径和第三路径传送的数据，其中，所述第一路径是用于在通过所述校验子计算而检测到没有错误时将所述码字传送到所述路径控制器的路径，其中，所述第二路径包括单个错误解码逻辑电路，并且所述单个错误解码逻辑电路在通过所述校验子计算而检测到所述码字的单个错误时校正所述单个错误以将被校正的码字经由所述第二路径传送到所述路径控制器，其中，所述第三路径包括多个错误解码逻辑电路，并且所述多个错误解码逻辑电路在通过所述校验子计算而检测到所述码字的至少两个错误时校正所述至少两个错误以将被校正的码字传送到所述路径控制器，其中，所述多个错误解码逻辑电路包括关键方程求解器KES块，被配置成从所述校验子计算块接收所述校验子并且被配置成计算并输出识别错误位置和错误量的错误位置量多项式，其中，所述KES块包括：多个KES级，被配置成级联，其中所述多个KES级中的每个KES级被配置成计算并输出所述错误位置量多项式；以及KES路径控制器，被配置成接收从所述多个KES级输出的所述错误位置量多项式并且被配置成以与所述错误位置量多项式被输入到所述KES路径控制器相同的顺序来输出所述错误位置量多项式，以及其中，所述多个KES级中的每个KES级被配置成在计算所述错误位置量多项式以提供识别出的错误位置和识别出的错误量时将所述错误位置量多项式直接传送到所述KES路径控制器。
全文数据：
权利要求：
百度查询： 爱思开海力士有限公司 具有低延时的错误校正码ECC解码器
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