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申请/专利权人：弗莱克斯-罗技克斯技术公司
摘要：张量处理单元内的乘法‑累加处理器在乘法‑累加周期序列中的每个周期中使用共享输入数据操作数和相应的加权操作数同时执行相应的乘法运算，每个乘法‑累加处理器在每个相继的乘法‑累加周期中应用新的共享输入数据操作数和相应的加权操作数以将相应的乘法乘积的和累加为输出张量的分量。
主权项：1.一种集成电路设备，包括：广播数据线；以及多个乘法-累加MAC电路，共同耦合到广播数据线，MAC电路中的每个MAC电路具有组件电路系统以：在第一时钟周期期间接收经由广播数据线传递的第一共享数据值，然后在第二时钟周期期间接收经由广播数据线传递的第二共享数据值；在第二时钟周期期间将第一共享数据值与加权值的第一集合中的相应加权值相乘以生成第一多个乘法乘积中的相应乘法乘积，然后在第三时钟周期期间将第二共享数据值与加权值的第二集合中的相应加权值相乘以生成第一多个乘法乘积中的相应乘法乘积；以及在第三时钟周期期间将第一多个乘法乘积中的相应乘法乘积添加到多个乘积-累加中的相应乘积-累加，然后在第四时钟周期期间将第二多个乘法乘积中的相应乘法乘积添加到所述多个乘积-累加。
全文数据：
权利要求：
百度查询： 弗莱克斯-罗技克斯技术公司 利用广播数据的乘法-累加
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