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申请/专利权人：上海交通大学
摘要：本发明提供了一种面向卷积神经网络的DSP紧缩字乘法方法及系统，设计出一种基于FPGA上DSP资源实现的紧缩字乘法计算模式。紧缩字乘法即利用数据量化的低比特优势，在一个DSP内部实现多个四比特乘法，提高资源的利用效率。此外，由于FPGA对DSP单元之间的级联进行了专门优化，因此本发明又利用DSP单元的级联实现了紧缩字乘累加，即完成多次紧缩字乘法并累加后，再从紧缩字乘积中提取出运算结果。本发明充分利用了DSP的特性，提高了DSP的利用效率，有利于系统能效比的优化。
主权项：1.一种面向卷积神经网络的DSP紧缩字乘法方法，其特征在于，所述方法包括如下步骤：步骤S1：将乘累加单元的四个输入，两个权重和两个输入激活值通过移位-加法模块分别打包；步骤S2：以紧缩字的形式作为DSP的操作数；步骤S3：使用DSP同时完成乘法操作；步骤S4：从DSP的输出结果中提取乘法操作的计算结果，完成卷积乘累加后的四个部分和；将部分和作进一步的累加操作，完成完整的卷积运算；所述步骤S1中权重为两个4bits，输入激活值为两个4bits；所述步骤S3中使用一个DSP完成四个乘法操作。
全文数据：
权利要求：
百度查询： 上海交通大学 面向卷积神经网络的DSP紧缩字乘法方法及系统
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