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申请/专利权人：普里露尼库斯新加坡私人有限公司
申请日：2022-11-18
公开（公告）日：2024-07-05
公开（公告）号：CN118302812A
主分类号：G11C5/06
分类号：G11C5/06;G11C7/10;G11C7/12;G11C7/18;G11C11/419
优先权：["20211119 US 63/281552"]
专利状态码：在审-实质审查的生效
法律状态：2024.07.23#实质审查的生效;2024.07.05#公开
摘要：本揭露涉及存储阵列的中继器。在一些实施例中，多个中继器可连接多个存储单元中的各个存储单元。每个中继器可以包含连接第一位元线的第一输入节点和连接第二位元线的第二输入节点；连接第一位元线的第一输出节点和连接第二位元线的第二输出节点；一对开关，连接第一位元线和第二位元线，用于接收输入信号的；交叉耦合的一组反相器，连接该对开关，用于处理该对开关接收到的输入信号，其中该对开关与交叉耦合的该组的反相器在第一位元线和第二位元线之间形成分流连接。
主权项：1.一种存储阵列，包含：多个存储单元，用于储存数据；一对位元线驱动器，用于提供一差分信号，该差分信号用于将数据写入至一对位元线上的所述多个存储单元中的至少一存储单元；一感测放大器，通信连接所述对位元线驱动器，以读取储由所述多个存储单元中的至少一部分存储单元存储的数据；以及多个中继器，串联连接所述多个存储单元，所述多个中继器中的每个中继器通过各自的分流连接到所述一对位元线驱动器，其中所述多个中继器中的每个中继器包含：一输入节点及一输出节点，配置于每条位元线上；一组交叉耦合的反相器，用于接收、再生及输出所述差分信号；一第一开关及一第二开关，用于在写入模式时向所述一组交叉耦合的反相器提供所述差分信号，或在读取模式时绕过所述一组交叉耦合的反相器，其中：所述对位元线在一第一节点上连接所述对位元线驱动器，一中间节点，被配置在所述第一节点和所述多个中继器中的一第一中继器的所述输入节点之间的每条位元线上，以及一新增的中间节点，被配置在给定的一中继器的所述输出节点和后续的一中继器的所述输入节点之间的每条位元线上。
全文数据：
权利要求：
百度查询： 普里露尼库斯新加坡私人有限公司 内含中继缓冲器的存储阵列
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