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MCM USR SERDES中的通道之间的相位检测器命令传播 

申请/专利权人:迈络思科技有限公司

申请日:2021-03-16

公开(公告)日:2024-06-28

公开(公告)号:CN113497701B

主分类号:H04L7/033

分类号:H04L7/033;H04L7/02

优先权:["20200319 US 16/823,577"]

专利状态码:有效-授权

法律状态:2024.06.28#授权;2021.10.29#实质审查的生效;2021.10.12#公开

摘要:多芯片模块(MCM)包括MCM基板,以及至少数据产生IC(DPIC)和数据消耗IC(DCIC),其都安装在MCM基板上并通过至少包括第一嵌入式时钟数据通道和第二嵌入式时钟数据通道的高速总线相互连接。DCIC包括时钟数据恢复电路(CDR)和数据采样器。CDR被配置为从第一数据通道恢复数据和时钟,并输出相位校正信令。数据采样器被配置为通过以响应于从第一数据通道导出的相位校正信令的相位对第二数据通道进行采样来从第二数据通道恢复数据。

主权项:1.一种多芯片模块(MCM),包括:MCM基板;和至少一个数据产生IC(DPIC)和至少一个数据消耗IC(DCIC),所述数据产生IC(DPIC)和数据消耗IC(DCIC)安装在所述MCM基板上,并通过至少包括第一嵌入式时钟数据通道和第二嵌入式时钟数据通道的高速总线相互连接;其中所述DCIC包括:时钟数据恢复电路(CDR),其被配置为从所述第一嵌入式时钟数据通道恢复数据和时钟,并输出相位校正信令;和数据采样器,其被配置为通过以响应于从所述第一嵌入式时钟数据通道导出的所述相位校正信令的相位对所述第二嵌入式时钟数据通道进行采样来从所述第二嵌入式时钟数据通道恢复所述数据,并且,其中所述数据恢复电路包括可配置为以第一配置操作的电路的第一实例,所述采样器包括可配置为以第二配置操作的电路的第二实例,其中:在所述第一配置中,所述电路被配置为从数据通道恢复所述数据并产生相位校正信令,以及在所述第二配置中,所述电路被配置为从对等电路接收所述相位校正信令,并基于从所述对等电路接收的所述相位校正信令从所述数据通道恢复所述数据。

全文数据:

权利要求:

百度查询: 迈络思科技有限公司 MCM USR SERDES中的通道之间的相位检测器命令传播

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