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申请/专利权人：无锡摩芯半导体有限公司

摘要：本发明涉及芯片验证技术领域，且公开了一种基于uvm的APB_bridge子系统级的验证平台的搭建方法，包括如何对apb子系统模块进行验证；如何搭建验证平台；参考模型设计；如何实现自对比以及时序监控。通过不同类中agent组件驱动对应interface，来完成对dut的输出驱动，能够准确、低耦合地将各个信号驱动到设计当中，也能监控用例的行为，实现参考模型和dut的输入同步，通过Matlab提供的转换方式，可以将M函数“无损”地转换为C函数，降低仿真对于联合仿真的多语言之间的同步要求和性能损耗，将原本需要的UVM‑C‑Matlab的语言同步接口问题简化，更加便于调试，在env中例化了两个都派生至reg_block的寄存器模型，实现用例和参考模型驱动的同步动作，保证寄存器模型值的正确性。

主权项：1.一种基于uvm的APB_bridge子系统级的验证平台的搭建方法，其特征在于，包括以下步骤：S1、验证人员将整个dig_top例化到tb_top当中，此时对APB子系统模块的验证环境进行搭建，通过AMBA_VIP，采用AMBA--AHBToAPBBridge的连接挂载方式，与apb从机模块进行通信，最后将monitor采样端口连接；S2、除了将apb_bridge的总线接口连接到ahb_vip，还需要将DUT的输入输出连接到环境，针对不同的接口信号时序，要定义不同类型agent组件，每个agent中需要定义符合dut要求的driver和sequencer，将每种不同输入时序接口的配置封装为sequence，并加入base_test；S3、在ref_mode里嵌入Matlab模型，当UVM验证平台产生激励数据包并发送给RTL代码被测对象，同时将此数据记录下来，发送给ref_mode，经过模型将信号作同步处理后发送到scoreboard，RTL代码被测对象再输出数据信号给scoreboard，scoreboard会对两组数据流进行比较，判断是否正确；S4、时序检测：通过ref_mode完成对功能的模拟和确认之后，验证工程师还需要对设计的时序进行确定和检测；S5、计分板scoreboard的实现：计分板通过TLM端口接受报文，保存在内置缓存队列，报文来自ref-mode输出的期望值和DUT输出的实际值，它们通过先进先出的方式实现对比，加入大量打印报文，来输出仿真对比报告；S6、uvm环境和用例：根据接口的个数及类型，分别配置构成对应agent组件，它们共同集成在一颗env树，整个子系统的多个模块可以产生多棵env树共同生长在一个uvm_test_top上，在同一个验证环境中可以针对多种接口进行验证，UVM组件可以通过脚本调用vcs的自动生成指令来完成，并定制符合模型需要的子系统环境，用例则根据需求调用vip和自定义sequence，将通用激励集成为sequence集合。

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