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龙图腾网恭喜山东航天电子技术研究所申请的专利一种软件控制的基于FPGA的内存数据容错系统及方法获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN115237646B 。

龙图腾网通过国家知识产权局官网在2025-05-23发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202210790851.5，技术领域涉及：G06F11/07；该发明授权一种软件控制的基于FPGA的内存数据容错系统及方法是由赵雪纲;赵新鹏;邱化强;郑晓朋;徐国良;吴亚光;程显光设计研发完成，并于2022-07-05向国家知识产权局提交的专利申请。

本一种软件控制的基于FPGA的内存数据容错系统及方法在说明书摘要公布了：本发明涉及星载计算机内存数据容错领域，具体涉及一种软件控制的基于FPGA的内存数据容错系统及方法。内存数据容错系统包括控制器端DIMM接口、FPGA和设备端DIMM接口；所述FPGA上设置有配置数据修改模块和容错逻辑模块，所述配置数据修改模块用于根据所述CPU的指示动态配置所述FPGA中具体容错逻辑。所述容错逻辑模块包括PHY_dev接口、命令解析模块、校验编码模块、冗余控制模块、数据地址转换模块、故障检测模块、数据校验模块、数据选择模块和PHY_host接口。所述PHY_dev接口包括CPU命令通路和CPU数据选通通路，所述PHY_host接口包括RAM命令通路和RAM数据选通通路。本发明可以使CPU端进行内存数据的读取无需进行任何处理即可达到容错效果。

本发明授权一种软件控制的基于FPGA的内存数据容错系统及方法在权利要求书中公布了：1.一种软件控制的基于FPGA的内存数据容错系统，其特征在于：包括控制器端DIMM接口、FPGA和设备端DIMM接口，所述控制器端DIMM接口连接CPU与所述FPGA，所述设备端DIMM接口连接所述FPGA与RAM；所述FPGA上设置有配置数据修改模块和容错逻辑模块，所述配置数据修改模块用于根据所述CPU的指示动态配置所述FPGA中具体容错逻辑；所述容错逻辑模块包括PHY_dev接口、命令解析模块、校验编码模块、冗余控制模块、数据地址转换模块、故障检测模块、数据校验模块、数据选择模块和PHY_host接口；所述PHY_dev接口包括CPU命令通路和CPU数据选通通路，所述PHY_host接口包括RAM命令通路和RAM数据选通通路；所述CPU数据选通通路包括DQ数据子通路Ⅰ和DQS数据子通路Ⅰ；所述DQ数据子通路Ⅰ为双向数据传输通路，所述DQ数据子通路Ⅰ包括输入输出缓存、输入输出延时单元、输入串并转换单元和输出双倍数据速率单元；所述DQS数据子通路Ⅰ为单项读通道，所述DQS数据子通路Ⅰ包括输出缓存、输出延时单元和输出双倍数据速率单元；所述RAM数据选通通路包括DQS数据子通路Ⅱ和DQ数据子通路Ⅱ，所述DQS数据子通路Ⅱ和DQ数据子通路Ⅱ均为双向数据传输通路；所述DQS数据子通路Ⅱ和DQ数据子通路Ⅱ均包括输出串并转换单元、输入双倍速率采集单元、输入输出延时单元和输入输出缓存器。

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