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龙图腾网恭喜博越微电子(江苏)有限公司申请的专利一种降低芯片对中介层走线干扰的方法获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN119647404B 。

龙图腾网通过国家知识产权局官网在2025-05-06发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202510173831.7，技术领域涉及：G06F30/398；该发明授权一种降低芯片对中介层走线干扰的方法是由张经伟;吴欣宇;刘德启设计研发完成，并于2025-02-18向国家知识产权局提交的专利申请。

本一种降低芯片对中介层走线干扰的方法在说明书摘要公布了：本发明公开了一种降低芯片对中介层走线干扰的方法，涉及集成电路设计技术领域。本发明通过精确识别和分类芯片中的电感区域，有效解决了背景技术中提到的信号干扰问题，在PHY、带宽扩展电感以及锁相环LC压控振荡器等关键区域，通过Virtuoso工具和图像处理算法，设计者能够根据实际版图识别电感区域，并利用PDKlayermap定义电感区域层次，确保电感区域在设计中被正确标记和处理，不仅提高了电感设计的准确性，而且通过仿真工具对电感进行建模和仿真，优化了电感的频率特性和品质因数，从而减少了电感在工作时产生的磁场对周围电路的干扰，提高了信号传输的质量和可靠性。

本发明授权一种降低芯片对中介层走线干扰的方法在权利要求书中公布了：1.一种降低芯片对中介层走线干扰的方法，其特征在于：包括如下步骤：识别出芯片中的电感区域，在PHY、带宽扩展电感以及锁相环LC压控振荡器中进行片上电感，通过virtuoso根据实际的版图识别出芯片中的电感区域，判断出电感；定义电感区域层次，在virtuoso中，定义一个初始的层次，用于覆盖在电感区域上，再根据每个厂商提供的PDKlayermap中的层次，选择初始的inductorlayer覆盖在电感区域，其中覆盖规则最外侧增加5um，覆盖图形为矩形，属性定义为pin；抽取电感区域信息，通过virtuoso工具抽取电感区域的层次、坐标和区域，通过virtuoso建立layoutcell，将芯片layout调入其中，使用PADOPENINGINFO抽取坐标，大小和名称；将PADOPENINGINFO抽取数据返回给TOP设计，再对比中介层走线区域和芯片电感区域；当判断电感区域有走线穿过，根据实际情况修改中介层的走线布局或芯片电感区域数据，使电感区域没有走线，当判断电感区域无走线，则流程完成；其中在根据实际情况修改中介层的走线布局或芯片电感区域数据之后，还包括：利用卷积神经网络算法和量化分析来识别并分类走线，通过自动布线算法为高频信号选择最优走线方案，同时对低频信号走线调整电感值和位置；所述利用卷积神经网络算法和量化分析来识别并分类走线，包括：根据预先建立的电路布局图像数据库识别电感区域范围，获取电感区域范围内部图像，并使用卷积神经网络算法提取走线特征，进行量化分析确定量化分析指标；当量化分析指标超出预设的阈值范围时，则判定走线存在，通过预设的走线规则识别走线类别信息；当走线类别信息属于高频信号走线时，则调用自动布线算法计算其他无高频信号走线干扰路径，确定备选走线方案集合。

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