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龙图腾网恭喜复旦大学申请的专利一种基于FPGA的面向DPU的令牌桶算法限流系统获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN115665053B 。

龙图腾网通过国家知识产权局官网在2025-04-29发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202211189936.4，技术领域涉及：H04L47/215；该发明授权一种基于FPGA的面向DPU的令牌桶算法限流系统是由李誉;王堃设计研发完成，并于2022-09-28向国家知识产权局提交的专利申请。

本一种基于FPGA的面向DPU的令牌桶算法限流系统在说明书摘要公布了：本发明公开了一种基于FPGA的面向DPU的令牌桶算法限流系统，该系统直接部署于FPGA上，且该系统通过PCI‑e接口与主机端的网卡实现连接；该系统包括系统配置模块、快速存储器访问模块、以太网介质访问控制器模块和两组用户逻辑框模块。本发明针对系统链路中流量突发的问题，根据令牌桶原理设计了流量控制方法，使得链路中的流量不会超过系统收发端的限制，并能够根据数据的类型提供不同的策略以满足用户要求，在保证系统安全运转的基础上，不浪费原有带宽，解决流量突发给DPU带来的不稳定因素；具备实现多路径、不同数据包的限流策略，而且部署上没有其他依赖的硬件、算法、协议资源和需求，可以直接在FPGA上使用的优点。

本发明授权一种基于FPGA的面向DPU的令牌桶算法限流系统在权利要求书中公布了：1.一种基于FPGA的面向DPU的令牌桶算法限流系统，设置于主机端与网络端之间的链路上，其特征在于：该系统直接部署于FPGA上，且该系统通过PCI-e接口与主机端的网卡实现连接；该系统包括系统配置模块、快速存储器访问模块、以太网介质访问控制器模块和两组用户逻辑框模块：UserLogicBox@322MHz模块和UserLogicBox@250MHz模块；所述系统配置模块用于储存系统配置相关的寄存器，且用于储存从主机端发送过来的对应寄存器修改指令的寄存器值，并使用AXI-lite协议与其它四个模块通讯，以改变已经部署的网卡的参数，使得网卡部署后，实现用户在主机上对网卡限流的流速的控制；快速存储器访问模块用于捕获主机端通过PCI-e接口发送的数据包，以及将网络端发送的上传用数据包发送至主机端，同时通过AXI-Stream流的协议与UserLogicBox@250MHz模块建立连接以发送或接收数据包；以太网介质访问控制器模块用于捕获来自于网络端的数据包或者向网络端发送数据包，从而为系统提供发送和接收数据的宽带；其中：所述UserLogicBox@322MHz模块负责数据包流量的传输，其由网卡工程直接以默认方式实例化后自动形成；所述UserLogicBox@250MHz模块用于数据包流量的控制处理，具体流程如下：解析获取的链路上的数据包以识别类别并得到传输路径，对已经类别的数据包根据数据包类型进行筛选分流，再基于单速率三色令牌桶算法，在链路资源充足，即Te≥EBS_1_x时进入IDLE模式不进行数据包的长度判断直接转发数据包，当链路资源低到一定阈值，即Te＜EBS_1_x时进入非IDLE模式，根据数据包的长度和链路中剩余资源判断，当满足Tc≥CBS_x_1且Te＝EBS时回到IDLE模式，不进行数据包的长度判断直接转发数据包；其中：Te表示当前传输路径可用于突发数据流使用的令牌资源数，EBS_1_x表示打开限流模式的令牌下限，Tc表示当前该传输路径中剩余的令牌资源数，CBS_x_1表示关闭限流模式的令牌上限，EBS表示令牌桶的超额突发尺寸。

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