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龙图腾网恭喜中国电子科技集团公司第五十八研究所申请的专利一种带同步功能DDS电路获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN115499003B 。

龙图腾网通过国家知识产权局官网在2025-04-29发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202211258931.2，技术领域涉及：H03L7/18；该发明授权一种带同步功能DDS电路是由张涛;张皓然;盛炜;王家琪;吴江设计研发完成，并于2022-10-14向国家知识产权局提交的专利申请。

本一种带同步功能DDS电路在说明书摘要公布了：本发明公开一种带同步功能DDS电路，属于集成电路领域，包括同步接收电路、同步发送电路、时钟分频及控制器、相位累加器、相幅转换器、数据合成器和数模转换器。在外部输入同步信号后，数字内核会自动与同步输入信号上升沿同步。本发明通过输入的同步信号进行边缘检测并实现内核时钟的同步，从而生成初始相位一致的数字正弦波形，实现多个DDS电路的输出同步，解决了多片DDS电路使用时初始相位不一致的问题，无需外部配置时钟或同步机制电路，简化了DDS应用时的电路配置及使用难度，可广泛应用于DDS或相关高速数模转换器电路中。

本发明授权一种带同步功能DDS电路在权利要求书中公布了：1.一种带同步功能DDS电路，其特征在于，包括：相位累加器，接收输入的Config信号，生成连续相位信号Phase1～Phasem；相幅转换器，将连续相位信号转换为连续幅度信号Amp1～Ampm；数据合成器，将连续幅度信号转换为交织数字正弦信号data1～datan；模拟接收及合成器，接收交织数字正弦信号，并合成为模拟差分信号Adatap和Adataq；数模转换器，将模拟差分信号转换为模拟正弦输出；同步接收电路，接收外部同步输入信号Sync_in并产生内部同步时钟fclk2；同步发送电路，将内部同步时钟fclk2转换为外部输出的同步输出信号Sync_out；时钟分频及控制器，将内部同步时钟fclk2处理为已同步的模块时钟fclkm、fclkm、fclk、fclk2、fclk，并分别提供给相位累加器、相幅转换器、数据合成器、模拟接收及合成器和数模转换器。

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