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龙图腾网恭喜深圳新港海岸科技有限公司申请的专利一种降低时钟信号抖动的电路获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN117595865B 。

龙图腾网通过国家知识产权局官网在2025-04-08发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202311709206.7，技术领域涉及：H03L7/10；该发明授权一种降低时钟信号抖动的电路是由皮德义;郑慧设计研发完成，并于2023-12-12向国家知识产权局提交的专利申请。

本一种降低时钟信号抖动的电路在说明书摘要公布了：本申请公开一种降低时钟信号抖动的电路，应用于电子电路技术领域。所述降低时钟信号抖动的电路包括：锁相环芯片和多个应用电路。所述锁相环芯片包括多个输出端，多个所述输出端分别与多个所述应用电路相连，多个所述输出端用于分别为多个所述应用电路提供时钟信号，多个所述应用电路为根据应用需求设计的电路；多个所述输出端中具有输出的时钟信号的频率和相位均相同的相关输出端，连接所述相关输出端。如此，通过在板级将锁相环芯片输出为同频同相的时钟信号的相关输出端连接起来，以降低应用电路接收到的同频同相的时钟信号的非相关噪声，从而降低时钟信号抖动。

本发明授权一种降低时钟信号抖动的电路在权利要求书中公布了：1.一种降低时钟信号抖动的电路，其特征在于，所述降低时钟信号抖动的电路包括：锁相环芯片和多个应用电路，其中：所述锁相环芯片包括多个输出端，多个所述输出端分别与多个所述应用电路相连，多个所述输出端用于分别为多个所述应用电路提供时钟信号，多个所述应用电路为根据应用需求设计的电路；多个所述输出端中具有输出的时钟信号的频率和相位均相同的相关输出端，连接所述相关输出端，所述相关输出端包括第一输出端和第二输出端；当所述时钟信号为差分信号时，所述降低时钟信号抖动的电路还包括第一缓冲器和第二缓冲器，所述多个所述输出端中具有输出的时钟信号的频率和相位均相同的相关输出端，连接所述相关输出端，包括：所述第一缓冲器的第一输入端与所述第一输出端的差分信号的正极相连；所述第一缓冲器的第二输入端与所述第二输出端的差分信号的负极相连；所述第二缓冲器的第一输入端与所述第二输出端的差分信号的正极相连；所述第二缓冲器的第二输入端与所述第一输出端的差分信号的负极相连；所述第一缓冲器的输出端和所述第二缓冲器的输出端分别与多个所述应用电路中的任一个应用电路相连。

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