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申请/专利权人：成都领目科技有限公司
摘要：本发明提供了一种自适应数据带宽的数据缓存传输方法及系统，涉及数据传输领域，包括以下步骤：S1：FPGA根据DDR通道的排序顺序依次判断DDR通道中当前待传输数据的数据量是否大于门限数据量；S2：判断当前待传输数据的数据量是否大于对应的DMA内存空间的所剩内存空间，若是，则转步骤S1，若否，则转步骤S3；S3：从状态寄存器中获得当前FPGA已传输数据量，根据当前FPGA已传输数据量、当前待传输数据量以及门限数据量计算得到当前待传输数据量写入到对应的DMA内存空间中的写入起始地址；S4：更新状态寄存器；从而，通过状态寄存器进行对数据传输过程进行流控，便于对FPGA已传输数据量和CPU已取走数据量进行记录，避免数据丢失，以保证数据传输的正确性。
主权项：1.一种自适应数据带宽的数据缓存传输方法，其特征在于，所述方法具体包括以下步骤：S0：FPGA获得所有DDR通道中的当前待传输数据，且每个DDR通道都具有各自的通道编号，所有DDR通道在通道编号的顺序下进行依次排序；S1：FPGA根据DDR通道的排序顺序依次获得DDR通道中的当前待传输数据，并判断当前待传输数据的数据量是否大于门限数据量，若是，则记录当前待传输数据并转步骤S2；S2：根据当前待传输数据所在DDR通道获得对应DMA内存空间的所剩内存空间，所述DMA内存空间与不同通道编号的DDR通道进行一一对应，并判断当前待传输数据的数据量是否大于对应的DMA内存空间的所剩内存空间，若是，则转步骤S1并获得下一DDR通道中的当前待传输数据，若否，则转步骤S3；S3：FPGA从对应的状态寄存器中获得当前FPGA已传输数据量，根据当前FPGA已传输数据量、当前待传输数据量以及门限数据量计算得到当前待传输数据量写入到对应的DMA内存空间中的写入起始地址，所述状态寄存器与不同通道编号的DDR通道进行一一对应；S4：FPGA将当前待传输数据通过高速总线传输给CPU进行数据写入，同时，更新对应状态寄存器中记录的当前FPGA已传输数据量。
全文数据：
权利要求：
百度查询： 成都领目科技有限公司 一种自适应数据带宽的数据缓存传输方法及系统
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