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申请/专利权人：苏州宽温电子科技有限公司

摘要：本发明涉及一种用于灵敏放大器的输出锁存电路，包括第一输出锁存电路模块和第二输出锁存电路模块，所述第一输出锁存电路模块的输出端DOB1和第二输出锁存电路模块的输出端DOB2连接，所述第一输出锁存电路模块分别与灵敏放大器SA1和灵敏放大器SA2连接，所述第二输出锁存电路模块分别与灵敏放大器SA1和灵敏放大器SA2连接。本发明的用于灵敏放大器的输出锁存电路可以显著提升存储器的整体性能、可靠性和集成度，满足现代高性能、低功耗存储器的需求。

主权项：1.一种用于灵敏放大器的输出锁存电路，其特征在于：包括第一输出锁存电路模块和第二输出锁存电路模块，所述第一输出锁存电路模块的输出端DOB1和第二输出锁存电路模块的输出端DOB2连接，所述第一输出锁存电路模块分别与灵敏放大器SA1和灵敏放大器SA2连接，所述第二输出锁存电路模块分别与灵敏放大器SA1和灵敏放大器SA2连接；所述第一输出锁存电路模块包括晶体管P10、晶体管P11、晶体管P12、晶体管P13、晶体管P14、晶体管P15、晶体管N10、晶体管N11、晶体管N12、晶体管N13、晶体管N14和晶体管N15；所述晶体管P15的漏极与电源VDD连接，所述晶体管P15的栅极的输出节点GDB2与灵敏放大器SA2连接，所述晶体管P15的源极与所述晶体管P10的漏极连接，所述晶体管P10的栅极包括第一支路和第二支路，所述晶体管P10的栅极的第一支路与所述晶体管P11的栅极连接，所述晶体管P10的栅极的第二支路与所述晶体管N14的栅极连接后的输出节点GDB1再与灵敏放大器SA1连接，所述晶体管P10的源极和所述晶体管P11的漏极连接，所述晶体管P11的源极和所述晶体管P12的漏极连接，所述晶体管P12的源极包括第一支路、第二支路和第三支路，所述晶体管P12的源极的第一支路为输出端DOB1，所述晶体管P12的源极的第二支路与分别与所述晶体管P12的栅极、所述晶体管P13的源极、所述晶体管P14的源极、以及所述晶体管N14的漏极连接，所述晶体管P12的源极的第三支路与所述晶体管N12的漏极连接，所述晶体管P12的栅极还与晶体管N12的栅极连接，所述晶体管N12的源极与所述晶体管N11的漏极连接，所述晶体管N11的栅极包括第一支路和第二支路，所述晶体管N11的栅极的第一支路与所述晶体管N10的栅极连接，所述晶体管N11的栅极的第二支路与所述晶体管P14的栅极连接后的输出节点GD01再与灵敏放大器SA1连接，所述晶体管N10的源极和所述晶体管N15的漏极连接，所述晶体管N15的栅极的输出节点GD02和灵敏放大器SA2连接，所述晶体管N15的源极与地线VSS连接；所述晶体管P13的漏极与电源VDD连接，所述晶体管P13的栅极与所述晶体管N13的栅极连接后的输出节点DOPD用于控制第一输出锁存电路模块工作或休眠，所述晶体管N13的源极与地线VSS连接，所述晶体管N13的漏极与所述晶体管N14的源极连接，所述晶体管P14的漏极与电源VDD连接；所述第二输出锁存电路模块包括晶体管P20、晶体管P21、晶体管P22、晶体管P23、晶体管P24、晶体管P25、晶体管N20、晶体管N21、晶体管N22、晶体管N23、晶体管N24和晶体管N25；所述晶体管P25的漏极与电源VDD连接，所述晶体管P25的栅极的输出节点GDB1与灵敏放大器SA1连接，所述晶体管P25的源极与所述晶体管P20的漏极连接，所述晶体管P20的栅极包括第一支路和第二支路，所述晶体管P20的栅极的第一支路与所述晶体管P21的栅极连接，所述晶体管P20的栅极的第二支路与所述晶体管N24的栅极连接后的输出节点GDB2再与灵敏放大器SA2连接，所述晶体管P20的源极和所述晶体管P21的漏极连接，所述晶体管P21的源极和所述晶体管P22的漏极连接，所述晶体管P22的源极包括第一支路、第二支路和第三支路，所述晶体管P22的源极的第一支路为输出端DOB2，所述输出端DOB2和所述输出端DOB1连接，所述晶体管P22的源极的第二支路与分别与所述晶体管P22的栅极、所述晶体管P23的源极、所述晶体管P24的源极、以及所述晶体管N24的漏极连接，所述晶体管P22的源极的第三支路与所述晶体管N22的漏极连接，所述晶体管P22的栅极还与晶体管N22的栅极连接，所述晶体管N22的源极与所述晶体管N21的漏极连接，所述晶体管N21的栅极包括第一支路和第二支路，所述晶体管N21的栅极的第一支路与所述晶体管N20的栅极连接，所述晶体管N21的栅极的第二支路与所述晶体管P24的栅极连接后的输出节点GD02再与灵敏放大器SA2连接，所述晶体管N20的源极和所述晶体管N25的漏极连接，所述晶体管N25的栅极的输出节点GD01和灵敏放大器SA1连接，所述晶体管N25的源极与地线VSS连接；所述晶体管P23的漏极与电源VDD连接，所述晶体管P23的栅极与所述晶体管N23的栅极连接后的输出节点DOPD用于控制第二输出锁存电路模块工作或休眠，所述晶体管N23的源极与地线VSS连接，所述晶体管N23的漏极与所述晶体管N24的源极连接，所述晶体管P24的漏极与电源VDD连接。

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