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一种增量编码器解码电路 

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申请/专利权人:智维精准(北京)医疗科技有限公司;智维精准(沈阳)医疗科技有限公司

摘要:本实用新型涉及解码电路技术领域,具体涉及一种增量编码器解码电路;包括边沿提取电路、计数控制电路、递增递减计数器和时钟SCLK;时钟SCLK用于接收SCLK信号;边沿提取电路用于提取A信号的上升沿、下降沿及B信号的上升沿、下降沿,并同步时钟SCLK;计数控制电路用于控制UP信号和DOWN信号的产生;递增递减计数器用于接收SCLK信号,并根据UP信号和DOWN信号进行计数增减,通过上述方式,实现了具有抗干扰能力,避免将干扰信号当做有效信号进行计数,造成位置累计的错误。

主权项:1.一种增量编码器解码电路,其特征在于,包括边沿提取电路、计数控制电路、递增递减计数器和时钟SCLK,所述边沿提取电路与所述计数控制电路连接,所述递增递减计数器与所述计数控制电路连接,所述边沿提取电路、所述计数控制电路和所述递增递减计数器分别设有所述时钟SCLK;所述时钟SCLK用于接收SCLK信号;所述边沿提取电路用于提取A信号的上升沿、下降沿及B信号的上升沿、下降沿,并同步所述时钟SCLK;所述计数控制电路用于控制UP信号和DOWN信号的产生;所述递增递减计数器用于接收SCLK信号,并根据UP信号和DOWN信号进行计数增减。

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