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申请/专利权人：北京中电华大电子设计有限责任公司
摘要：本发明公开了一种基于SPI的并行加解密通讯装置及方法。本发明装置包括SPIFlash主控制器模块，对称算法加解密模块，PUF模块与DMA模块，SPIFlash主控制器与CPU和DMA模块相连，用于与SPIFlash存储器件通讯时，CPU配置SPIFlash控制器通讯参数，并通过DMA模块自动搬移数据，对称算法加密模块与CPU模块和PUF模块相连，用于实现对通讯数据的加解密。本发明中SPIFlash主控制器模块与对称算法加解密模块，两模块总线间没有直接通讯，提高了加解密模块的复用性；利用SPIFlash存储器件的读写命令执行特性、总线数据传输速度与对称算法CTR模式加解密速度，将往SPIFlash存储器件传输的读写命令通讯时间与加解密时间并行运行，降低了执行成本，同时提高了加解密通讯效率。
主权项：1.一种基于SPI的并行加解密通讯装置，除了包括CPU、存储器和常规模块外，其特征在于，还包括SPIFlash主控制器模块，对称算法加解密模块，PUF模块与DMA模块，SPIFlash主控制器与CPU和DMA模块相连，用于与SPIFlash存储器件通讯时，CPU配置SPIFlash控制器通讯参数，并通过DMA模块自动搬移数据，对称算法加密模块与CPU模块和PUF模块相连，用于实现对通讯数据的加解密。
全文数据：
权利要求：
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