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多倍数据率的输出电路及集成电路 

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申请/专利权人:深圳开阳电子股份有限公司

摘要:本实用新型提供了一种多倍数据率的输出电路,该电路包括:多个D触发器、一个时钟倍频单元和一个选择控制输出单元;每个D触发器的输入端口连接一路输入数据,所述多个D触发器的时钟端口均连接同一时钟信号CLK;每个D触发器用于寄存一路数据;所述时钟倍频单元用于对时钟信号CLK执行倍频处理,得到多倍频的时钟信号,输入至所述选择控制输出单元;所述选择控制输出单元为多端输入单端输出结构,所述选择控制单元接收多个D触发器输出的数据,在倍频时钟信号的控制下,在一个时钟信号CLK周期内将多路数据中从选择控制输出单元的输出端口一一输出。该电路具有电路结构简单,速度快,占用面积小成本低等优点。

主权项:1.一种多倍数据率的输出电路,其特征在于,包括:多个D触发器、一个时钟倍频单元和一个选择控制输出单元;每个D触发器的输入端口连接一路输入数据,所述多个D触发器的时钟端口均连接同一时钟信号CLK;每个D触发器用于寄存一路数据;所述时钟倍频单元用于对时钟信号CLK进行倍频处理,得到多倍频的时钟信号,输入至所述选择控制输出单元;所述选择控制输出单元为多端输入单端输出结构,所述选择控制输出单元接收多个D触发器输出的数据,在倍频时钟信号的控制下,在一个时钟信号CLK周期内将多路数据中从选择控制输出单元的输出端口一一输出。

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