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申请/专利权人:常州觉致视知科技有限公司
摘要:本发明公开了一种可综合的ADC模拟电路的行为模型及仿真方法,包括电容式DAC和比较器,所述电容式DAC的输出端设置为Vx端,所述Vx端与比较器的其中一个输入端电性连接,所述比较器的另一个输入端电性连接有VCM端,所述Vx端与VCM端之间电性连接有导通开关;所述电容式DAC的输入端分别设置有VREF端、AnalogInput端和GND端,所述VREF端、AnalogInput端和GND端与Vx端之间设置有电容组,且所述电容组与VREF端、AnalogInput端和GND端之间设置有用于控制连接对象的三掷开关。本模型实现简单,只需要用到最基础的Verilog‑HDL语法,就能够实现SARADC模拟电路的行为模型。在数字控制器的开发前期,就能替代模拟电路加入联合仿真。相比于数模混合仿真,开展联合仿真的时间节点大大提前。
主权项:1.一种可综合的ADC模拟电路的行为模型,其特征在于,包括电容式DAC和比较器,所述电容式DAC的输出端设置为Vx端,所述Vx端与比较器的其中一个输入端电性连接,所述比较器的另一个输入端电性连接有VCM端,所述Vx端与VCM端之间电性连接有导通开关;所述电容式DAC的输入端分别设置有VREF端、AnalogInput端和GND端,所述VREF端、AnalogInput端和GND端与Vx端之间设置有电容组,且所述电容组与VREF端、AnalogInput端和GND端之间设置有用于控制连接对象的三掷开关。
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