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申请/专利权人：清华大学
摘要：本发明公开了一种可重构处理单元阵列的寄存器堆设计方法及装置，其中，该方法包括：采用数据局部和全局共享结合、数据和配置信息分离存储的方式，对每个可重构处理单元阵列PEA的全局寄存器堆GR进行设计，其中，每个PEA包括：多个处理器单元PE；采用数据和配置信息分离存储的方式，对每个PE的局部寄存器堆LR进行设计。本发明通过层次化的寄存器文件设计，能够充分利用可重构处理器单元阵列中各个处理单元的资源，提升可重构处理器单元阵列的系统性能。
主权项：1.一种可重构处理单元阵列的寄存器堆设计方法，其特征在于，包括：采用数据局部和全局共享结合、数据和配置信息分离存储的方式，对每个可重构处理单元阵列PEA的全局寄存器堆GR进行设计，其中，每个PEA包括：多个处理器单元PE；采用数据和配置信息分离存储的方式，对每个PE的局部寄存器堆LR进行设计；其中，采用数据局部和全局共享结合、数据和配置信息分离存储的方式，对每个可重构处理单元阵列PEA的全局寄存器堆GR进行设计，包括：对每个PEA中的多个PE进行区域划分，形成多个局部PEA；将GR中第一地址范围的寄存器设计为存储局部PEA数据的寄存器；将GR中第二地址范围的寄存器设计为存储全局PEA数据的寄存器；将GR中第三地址范围的寄存器设计为存储全局PEA配置信息的寄存器；其中，采用数据和配置信息分离存储的方式，对每个PE的局部寄存器堆进行设计，包括：将LR中第一地址范围的寄存器设计为存储PE数据的寄存器；将LR中第二地址范围的寄存器设计为存储PE配置信息的寄存器。
全文数据：
权利要求：
百度查询： 清华大学 可重构处理单元阵列的寄存器堆设计方法及装置
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