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申请/专利权人：山东浪潮科学研究院有限公司
摘要：本发明公开了基于RISC‑V架构的锁存IO端口系统及方法，属于芯片设计技术领域，要解决的技术问题为对于RISC‑V架构芯片、在线升级过程等场景下如何锁存IO端口。包括RISC‑V内核、保持使能模块、信息控制模块、上拉电阻、锁存使能模块、反相器、或门、用户模块、复用器以及IO端口逻辑模块；或门以信息控制模块输出的normal_operation信号以及经过反相器后的锁存使能信号Hitless_en作为输入，输出选择信号Mux_sel；用户模块接收IO端口逻辑模块输出的反馈信号C_in2，输出当前用户逻辑设计中的C_in2，复用器以Mux_sel为输入，选择输出C_in1或C_in2。
主权项：1.一种基于RISC-V架构的锁存IO端口系统，其特征在于，包括RISC-V内核、保持使能模块、信息控制模块、上拉电阻、锁存使能模块、反相器、或门、用户模块、复用器以及IO端口逻辑模块；所述RISC-V内核分别与保持使能模块和锁存使能模块电连接，用于接收上位机发送的指令，并基于指令驱动保持使能模块输出的保持使能信号Hold_preload以及驱动锁存使能模块输出的锁存使能信号Hitless_en；所述信息控制模块与所述使能保持模块电连接，检测到保持使能信号Hold_preload的下降沿时，用于将其输出的normal_operation信号置为零；所述锁存使能模块与所述上拉电阻电连接，上拉电阻用于拉高锁存使能模块输出的锁存使能信号Hitless_en；所述或门以信息控制模块输出的normal_operation信号以及经过反相器后的锁存使能信号Hitless_en作为输入，输出选择信号Mux_sel；所述用户模块用于接收IO端口逻辑模块输出的反馈信号C_in2，输出当前用户逻辑设计中的信号C_in2，所述复用器以选择信号Mux_sel为输入，选择输出信号C_in1或反馈信号C_in2。
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百度查询： 山东浪潮科学研究院有限公司 基于RISC-V架构的锁存IO端口系统及方法
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