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申请/专利权人：苏州工业园区慧鱼科技有限公司

摘要：本发明涉及一种基于FPGA的线缆测试方法及设备，包括用于生成测试信号的发生模块、用于接收信号的接收模块、用于计算分析信号的分析模块、用于配置参数的人机交互模块，线缆测试方法包括高速信号测试方法，该方法通过在测试信号N个连续时钟周期T内的T2处设定基准点PN，并采样基准结果AN；然后在PN的时间点延迟或提前时间t，并对信号施加电平偏置v，以得到采样结果nAN；通过将nAN与AN进行对比，以获得对应采样点的误码率二维矩阵，然后将二维矩阵渲染成数据眼图，并根据数据眼图的眼宽和眼高评估线缆质量，不仅可以便捷且直观的获取测试结果，还减少了为适应不同规格的线缆所消耗的成本，并且还保证了测试结果的准确性。

主权项：1.一种基于FPGA的线缆测试方法，其特征在于，采用基于FPGA的线缆测试系统，所述测试系统包括：发生模块，用于生成测试信号，所述发生模块包括高速信号发生器、低速信号发生器、用于给被测线缆提供电平的DC模块；接收模块，用于接收所述测试信号，所述接收模块包括高速信号接收器、低速信号接收器、用于对所述高速信号接收器接收的高速信号进行采样的采样模块、用于对所述DC模块提供的电平加入负载并进行采样的AD模块；分析模块，与所述接收模块连接并用于对所述采样模块和所述AD模块采集的信号进行计算、分析；人机交互模块，与所述发生模块、所述接收模块及所述分析模块连接并用于配置所述发生模块、所述接收模块和所述分析模块的测试参数；对被测线缆进行测试时，将被测线缆的两端分别连接所述发生模块的输出端和所述接收模块的输入端；所述线缆测试方法包括高速信号测试方法，该高速信号测试方法包括：S1、根据被测线缆的规格型号在所述人机交互模块中预设被测线缆高速信号测试的合格眼宽X与合格眼高Y；S2、所述人机交互模块控制所述发生模块根据被测线缆的接口类型及协议与所述接收模块建立连接，并通过所述高速信号发生器生成并发出高速测试信号，所述高速测试信号的时钟周期为T，基础电平为V；S3、所述接收模块通过所述高速信号接收器接收所述高速测试信号，并通过所述采样模块对所述高速测试信号进行采样，并将采样结果发送至所述分析模块；所述采样模块的采样方法包括：a、设所述高速测试信号单个时钟周期T内T2处的时间点为基准点P，N个连续的时钟周期T内的基准点记录为Pn，分别对点Pn进行采样，获得点Pn所对应的采样基准结果An，其中1≤n≤N，且N为大于等于2的整数；b、分别在点Pn所处的时间点上提前或延迟时间tm，记录为采样点Pmn，分别对点Pmn对应的所述高速测试信号施加电平偏置vm，然后进行采样，并记录对应的采样结果Amn，单个时钟周期T中，对点Pn施加时间提前或延迟以及电平偏置的次数为M，其中，1≤m≤M，且M为大于等于2的整数，并且，0＜tm＜T，0＜|vm|＜|V|；S4、所述分析模块根据采样结果计算所述高速测试信号的误码率S，并根据计算得的误码率S对应的采样位置生成用于显示误码率S分布位置的二维矩阵，然后将所述二维矩阵发送至所述人机交互模块；计算误码率S的方法为：将采样结果Amn与对应的采样基准结果An进行一一对比，如Amn=An，则Pmn点的采样未出现误码，反之则出现误码，并记录误码次数Cm，然后计算误码率Sm=CmN；生成所述二维矩阵的方法为：将高速信号N个时钟周期的波形以及其中的采样点进行重叠，然后将点Pmn重叠后所在的点位设为Qm，点Qm则对应误码率Sm，所述二维矩阵即为点Qm的集合所形成点阵；S5、所述人机交互模块根据所述二维矩阵生成数据眼图，并将所述数据眼图的实际眼宽x和实际眼高y与合格眼宽X和合格眼高Y进行对比，如x≥X，且y≥Y，则所述人机交互模块判定被测线缆的高速信号测试合格，反之则判定不合格。

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