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申请/专利权人：深圳通锐微电子技术有限公司

摘要：本申请公开一种栅极驱动器和电源转换设备，所述栅极驱动器包括触发模块、逻辑处理模块和供电模块；所述触发模块的输入端连接栅极驱动端，用于接入输入所述栅极驱动端的驱动信号，输出用于表征驱动阶段的触发信号；所述逻辑处理模块用于对所述触发信号和输入信号进行逻辑处理，以使所述供电模块在各个所述驱动阶段为所述栅极驱动端提供对应的驱动信号。本申请在保证驱动效率的基础上，尽可能抑制电磁干扰，能够使栅极驱动器所在的电源设备尽可能抑制电磁干扰，还能够提升工作效率。

主权项：1.一种栅极驱动器，其特征在于，所述栅极驱动器包括触发模块、逻辑处理模块和供电模块；所述触发模块的输入端连接栅极驱动端，用于接入输入所述栅极驱动端的驱动信号，输出用于表征驱动阶段的触发信号；所述逻辑处理模块用于对所述触发信号和输入信号进行逻辑处理，以使所述供电模块在各个所述驱动阶段为所述栅极驱动端提供对应的驱动信号；所述驱动阶段包括第一阶段、第二阶段和第三阶段，所述第一阶段和所述第三阶段中所述驱动信号的上升速率为第一预设速率，所述第二阶段中所述驱动信号的上升速率为第二预设速率，所述第一预设速率为对应功率管栅极可承受的最大电压上升速率；所述触发模块包括第一触发单元和第二触发单元；所述触发信号包括第一触发单元输出的第一电平信号和第二触发单元输出的第二电平信号；所述第一电平信号和所述第二电平信号组合后用于表征对应的驱动信号属于哪一驱动阶段；所述第一触发单元和所述第二触发单元分别包括第一MOS管、第二MOS管、第三MOS管和第四MOS管；所述第一MOS管的源极用于接入电源电压，栅极用于接入所述驱动信号，并连接所述第二MOS管的栅极，漏极分别连接所述第二MOS管的漏极、所述第三MOS管的栅极和所述第四MOS管的栅极；所述第二MOS管的源极接地；所述第三MOS管的源极用于接入所述电源电压，漏极用于输出所述第一电平信号或者所述第二电平信号，并连接所述第四MOS管的漏极；所述第四MOS管的源极接地；所述逻辑处理模块包括解码器、第一与门、第二与门、第三与门、第四与门、第五与门、第六与门、第七与门、第一非门、第二非门、第三非门、第四非门、第五非门、第六非门、第七非门、第五MOS管、第六MOS管、第七MOS管、第八MOS管、第九MOS管、第十MOS管和第十一MOS管；所述解码器用于解码各个驱动阶段对应的斜率控制信号，输出第一阶段对应的第一斜率参数、第二阶段对应的第二斜率参数和第三阶段对应的第三斜率参数；所述第一与门的第一输入端用于接入第一电平信号的取反信号，第二输入端用于接入第二电平信号的取反信号，第三输入端用于接入所述输入信号，输出端连接所述第一非门的输入端；所述第二与门的第一输入端用于接入第一电平信号的取反信号，第二输入端用于接入第二电平信号，第三输入端用于接入所述输入信号，输出端分别连接所述第四与门的第一输入端、第五与门的第一输入端、第六与门的第一输入端、第七与门的第一输入端；所述第三与门的第一输入端用于接入第一电平信号，第二输入端用于接入第二电平信号，第三输入端用于接入所述输入信号，输出端连接所述第二非门的输入端；所述第三非门的输入端用于接入所述输入信号，输出端连接所述第十一MOS管的栅极；所述第四与门的第二输入端用于接入所述第三斜率参数，输出端连接第四非门的输入端；所述第五与门的第二输入端用于接入所述第二斜率参数，输出端连接第五非门的输入端；所述第六与门的第二输入端用于接入所述第一斜率参数，输出端连接第六非门的输入端；所述第七与门的第二输入端用于接入所述电源电压，输出端连接第七非门的输入端；所述第五MOS管的源极用于接入所述电源电压，栅极连接所述第一非门的输出端，漏极用于输出所述驱动信号，并分别连接所述第六MOS管的漏极、第七MOS管的漏极、第八MOS管的漏极、第九MOS管的漏极、第十MOS管的漏极和第十一MOS管的漏极；所述第六MOS管的源极用于接入所述电源电压，栅极连接所述第四非门的输出端；所述第七MOS管的源极用于接入所述电源电压，栅极连接所述第五非门的输出端；所述第八MOS管的源极用于接入所述电源电压，栅极连接所述第六非门的输出端；所述第九MOS管的源极用于接入所述电源电压，栅极连接所述第七非门的输出端；所述第十MOS管的源极用于接入所述电源电压，栅极连接所述第二非门的输出端；第十一MOS管的源极接地。

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